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參數(shù)資料
| 型號(hào)： | MB89F051PMC |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁(yè)數(shù)： | 29/40頁(yè) |
| 文件大小： | 931K |
| 代理商： | MB89F051PMC |
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MB89051 Series
DS07-12551-3E
35
(8) I2C Timing
(VCC
= 5.0 V, VSS = 0 V, TA = 40 °C to +85 °C)
*1 : For information on tinst, see “ (4) Instruction Cycle”.
*2 : m is defined in the ICCR CS 4 to CS 3 (bit 4 to bit 3) .
*3 : n is defined in the ICCR CS 2 to CS 0 (bit 2 to bit 0) .
Parameter
Sym
bol
Pin
Value
Unit
Remarks
Min
Max
Start condition output
tSTA
SCL,
SDA
1
/ 4 × tinst*1 ×
mt*
× nt*3 20
1
/ 4 × tinst*1 ×
mt*2
× nt*3 + 20
ns
Master
mode
Stop condition output
tSTO
SCL,
SDA
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) 20
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) + 20
ns
Master
mode
Start condition detect
tSTA
SCL,
SDA
1
/ 4 × tinst*1 × 6 + 40
ns
Stop condition detect
tSTO
SCL,
SDA
1
/ 4 × tinst*1 × 6 + 40
ns
Restart condition output tSTASU
SCL,
SDA
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) 20
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) + 20
ns
Master
mode
Restart condition detect tSTASU
SCL,
SDA
1
/ 4 × tinst*1 × 4 + 40
ns
SCL output Low width
tLOW
SCL
1
/ 4 × tinst*1 × mt*2 × nt*3
20
1
/ 4 × tinst*1 × mt*2 × nt*3
+ 20
ns
Master
mode
SCL output High width
tHIGH
SCL
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) 20
1
/ 4 × tinst*1 ×
(mt*2
× nt*3 + 8) + 20
ns
Master
mode
SDA output delay
tDO
SDA
1
/ 4 × tinst*1 × 4 20
1
/ 4 × tinst*1 × 4 + 20
ns
SDA output setup time
after interrupt
tDOSU
SDA
1
/ 4 × tinst*1 × 4 20
ns
SCL input Low pulse
width
tLOW
SCL
1
/ 4 × tinst*1 × 6 + 40
ns
SCL input High pulse
width
tHIGH
SCL
1
/ 4 × tinst*1 × 2 + 40
ns
SDA input setup time
tSU
SDA
40
ns
SDA hold time
tHO
SDA
0
ns
Data transmit (master/slave)
Data receive (master/slave)
9
ACK
tDO
tSU
tDOSU
tDO
tHO
tLOW
tSTA
SDA
SCL
1
tSTASU
SDA
SCL
67
8
9
tSU
tHIGH
tLOW
tHO
tDO
tDOSU
tSTO
ACK
相關(guān)PDF資料 |
PDF描述 |
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