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參數(shù)資料
| 型號： | MB814405D-7OL |
| 廠商： | Fujitsu Limited |
| 英文描述： | 1M ×4BIT Hyper Page Mode Dynamic RAM(CMOS 1M ×4 位超級頁面存取模式動態(tài)RAM) |
| 中文描述： | 100萬× 4位超頁模式動態(tài)RAM的CMOS（100萬× 4位超級頁面存取模式動態(tài)內(nèi)存） |
| 文件頁數(shù)： | 17/29頁 |
| 文件大?。?/td> | 596K |
| 代理商： | MB814405D-7OL |
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17
MB814405D-60/60L/-70/70L
Fig. 10 – HYPER PAGE MODE READ CYCLE (OE CONTROLLED)
RAS
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
CAS
WE
DQ
(Input)
A
0
to A
9
V
OH
V
OL
DQ
(Output)
V
IH
V
IL
OE
DESCRIPTION
The hyper page mode of operation permits faster successive memory operations at multiple column locations of the same row
address. This operation is performed by strobing in the row address and maintaining RAS at a Low level and WE at a High level
during all successive memory cycles in which the row address is latched. The access time is determined by t
CAC
, t
AA
, t
CPA
, or t
OEA
,
whichever one is the latest in occurring.
To obtain a high-impedance state, set OE or both RAS and CAS going high level.
“H” or “L”
Valid Data
During one cycle is achieved, the input/output timing apply the same manner as the former cycle.
t
RASP
t
ASC
t
RHCP
t
RP
t
RCD
t
AR
ROW
ADD
COL
ADD
t
CAS
t
RSH
t
HPC
t
CAS
t
CP
t
DZC
t
CAH
t
CAH
t
RAH
t
ASC
t
RRH
t
CAH
t
ASC
t
RCH
t
CAC
t
AA
t
RAD
COL
ADD
t
RAL
HIGH-Z
HIGH-Z
t
OFR
HIGH-Z
t
OFF
t
OH
t
OEZ
t
OED
t
CAC
t
OH
t
OH
t
AA
t
CPA
t
CAC
t
AA
t
OEA
t
OECH
t
OEP
t
OH
t
OEA
t
DZO
t
ON
t
RAC
t
CP
t
CDD
t
OEZ
t
COL
t
OEA
t
OH
t
OEZ
t
ASR
t
CRP
t
RCS
t
CSH
t
CAS
t
CAL
t
CPA
t
RDD
COL
ADD
t
ON
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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