參數(shù)資料
型號： M62P
廠商： Mitsubishi Electric Corporation
英文描述： SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
中文描述： 單片16位CMOS微機(jī)
文件頁數(shù)： 146/349頁
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代理商： M62P
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Serial I/O
145
Mitsubishi microcomputers
M16C / 62P Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
development
Preliminary Specifications Rev.1.0
Specifications in this manual are tentative and subject to change.
Figure 1.17.6. UCON Register and U0SMR to U2SMR Registers
Note: When using multiple transfer clock output pins, make sure the following conditions are met:
U1MR register’s CKDIR bit = “0” (internal clock)
UART transmit/receive control register 2
Symbol
UCON
Address
03B0
16
After reset
X0000000
2
b7
b6
b5
b4
b3
b2
b1
b0
Bit
name
Bit
symbol
RW
Function
CLKMD0
CLKMD1
UART0 transmit
interrupt cause select bit
UART0 continuous
receive mode enable bit
0 : Continuous receive mode disabled
1 : Continuous receive mode enable
UART1 continuous
receive mode enable bit
UART1 CLK/CLKS
select bit 0
UART1 transmit
interrupt cause select bit
0 : Transmit buffer empty (Tl = 1)
1 : Transmission completed (TXEPT = 1)
0 : Transmit buffer empty (Tl = 1)
1 : Transmission completed (TXEPT = 1)
0 : CLK output is only CLK1
1 : Transfer clock output from multiple pins function
selected
0 : Continuous receive mode disabled
1 : Continuous receive mode enabled
Effective when CLKMD1 = “1”
0 : Clock output from CLK1
1 : Clock output from CLKS1
Nothing is assigned. When write, set “0”. When read, its content is indeterminate.
U0IRS
U1IRS
U0RRM
U1RRM
UART1 CLK/CLKS
select bit 1 (Note)
UART2 special mode register (i=0 to 2)
Symbol
Address
After reset
X0000000
2
U0SMR to U2SMR
036F
16
, 0373
16
, 0377
16
b7 b6
b5
b4
b3
0
b2
b1 b0
Bit
name
Bit
symbol
Function
ABSCS
ACSE
SSS
I
2
C mode select bit
Bus busy flag
0 : STOP condition detected
1 : START condition detected (busy)
Bus collision detect
sampling clock select bit
Arbitration lost detecting
flag control bit
0 : Other than I
2
C mode
1 : I
2
C mode
0 : Update per bit
1 : Update per byte
IICM
ABC
BBS
0 : Irrelevant to RxDi
1 : Synchronous with RxDi (Note 3)
Set to “0”
Transmit start condition
select bit
0 : Rising edge of transfer clock
1 : Underflow signal of timer Aj (Note 2)
Auto clear function
select bit of transmit
enable bit
0 : No auto clear function
1 : Auto clear at occurrence of bus collision
Note 1: The BBS bit is set to “0” by writing “0” in a program. (Writing “1” has no effect.).
Note 2: Underflow signal of timer A3 in UART0, underflow signal of timer A4 in UART1, underflow signal of timer A0 in UART2.
Note 3: When a transfer begins, the SSS bit is set to “0” (irrelevant to RxDi).
(Note1)
RCSP
Separate UART0
CTS/RTS bit
0 : CTS/RTS shared pin
1 : CTS/RTS separated (CTS
0
supplied from the P6
4
pin)
Nothing is assigned. When write, set “0”. When read, its content is indeterminate.
RW
RW
RW
RW
RW
RW
RW
(b7)
RW
RW
RW
RW
RW
RW
RW
RW
(b7)
(b3)
Reserved bit
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