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參數(shù)資料
| 型號： | M44C090-XXX-FL16 |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PDSO16 |
| 文件頁數(shù)： | 57/319頁 |
| 文件大?。?/td> | 11009K |
| 代理商： | M44C090-XXX-FL16 |
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15
Atmel ATmega16/32/64/M1/C1 [DATASHEET]
7647K–AVR–12/13
3.6
Stack Pointer
The stack is mainly used for storing temporary data, for storing local variables and for storing return addresses after interrupts
and subroutine calls. The stack pointer register always points to the top of the stack. Note that the stack is implemented as
growing from higher memory locations to lower memory locations. This implies that a Stack PUSH command decreases the
stack pointer.
The stack pointer points to the data SRAM stack area where the subroutine and interrupt stacks are located. This stack space in
the data SRAM must be defined by the program before any subroutine calls are executed or interrupts are enabled. The stack
pointer must be set to point above 0x100. The stack pointer is decremented by one when data is pushed onto the stack with the
PUSH instruction, and it is decremented by two when the return address is pushed onto the stack with subroutine call or
interrupt. The stack pointer is incremented by one when data is popped from the stack with the POP instruction, and it is
incremented by two when data is popped from the stack with return from subroutine RET or return from interrupt RETI.
The AVR stack pointer is implemented as two 8-bit registers in the I/O space. The number of bits actually used is
implementation dependent. Note that the data space in some implementations of the AVR architecture is so small that only SPL
is needed. In this case, the SPH Register will not be present.
3.7
Instruction Execution Timing
This section describes the general access timing concepts for instruction execution. The AVR CPU is driven by the CPU clock
clkCPU, directly generated from the selected clock source for the chip. No internal clock division is used.
Figure 3-4 shows the parallel instruction fetches and instruction executions enabled by the Harvard architecture and the fast-
access Register File concept. This is the basic pipelining concept to obtain up to 1 MIPS per MHz with the corresponding unique
results for functions per cost, functions per clocks, and functions per power-unit.
Figure 3-4.
The Parallel Instruction Fetches and Instruction Executions
Bit
15141312
11
10
9
8
SP15
SP14
SP13
SP12
SP11
SP10
SP9
SP8
SPH
SP7
SP6
SP5
SP4
SP3
SP2
SP1
SP0
SPL
76543210
Read/Write
R/W
Initial Value
Top address of the SRAM (0x04FF/0x08FF/0x10FF)
clk
CPU
1st Instruction Fetch
1st Instruction Execute
2nd Instruction Fetch
T1
T2
T3
T4
2nd Instruction Execute
3rd Instruction Fetch
3rd Instruction Execute
4th Instruction Fetch
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M44C090-XXX-DIT | 4-BIT, MROM, 4 MHz, MICROCONTROLLER, UUC |
| M48ST59W-70MH1TR | 0 TIMER(S), REAL TIME CLOCK, PDSO44 |
| M48ST59W-100MH1 | 0 TIMER(S), REAL TIME CLOCK, PDSO44 |
| M48T02-150PC1 | 0 TIMER(S), REAL TIME CLOCK, PDIP24 |
| M48T18-100MH1TR | 0 TIMER(S), REAL TIME CLOCK, PDSO28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M44C890 | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-Current Microcontroller for Wireless Communication |
| M44C890-H | 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Low-Current Microcontroller for Wireless Communication |
| M44S05K4F1 | 功能描述:汽車連接器 MX44 Terminals RoHS:否 制造商:Amphenol SINE Systems 產(chǎn)品:Contacts 系列:ATP 位置數(shù)量: 型式:Female 安裝風(fēng)格: 端接類型: 觸點電鍍:Nickel |
| M44T332538880MHZ | 制造商:MEC 功能描述: |
| M44T3338880MHZ | 制造商:MEC 功能描述: |
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