- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄98007 > M38B79FFFP 8-BIT, FLASH, 4.2 MHz, MICROCONTROLLER, PQFP100 PDF資料下載
參數(shù)資料
| 型號(hào)： | M38B79FFFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 4.2 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 68/414頁(yè) |
| 文件大?。?/td> | 4296K |
| 代理商： | M38B79FFFP |
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)當(dāng)前第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)第254頁(yè)第255頁(yè)第256頁(yè)第257頁(yè)第258頁(yè)第259頁(yè)第260頁(yè)第261頁(yè)第262頁(yè)第263頁(yè)第264頁(yè)第265頁(yè)第266頁(yè)第267頁(yè)第268頁(yè)第269頁(yè)第270頁(yè)第271頁(yè)第272頁(yè)第273頁(yè)第274頁(yè)第275頁(yè)第276頁(yè)第277頁(yè)第278頁(yè)第279頁(yè)第280頁(yè)第281頁(yè)第282頁(yè)第283頁(yè)第284頁(yè)第285頁(yè)第286頁(yè)第287頁(yè)第288頁(yè)第289頁(yè)第290頁(yè)第291頁(yè)第292頁(yè)第293頁(yè)第294頁(yè)第295頁(yè)第296頁(yè)第297頁(yè)第298頁(yè)第299頁(yè)第300頁(yè)第301頁(yè)第302頁(yè)第303頁(yè)第304頁(yè)第305頁(yè)第306頁(yè)第307頁(yè)第308頁(yè)第309頁(yè)第310頁(yè)第311頁(yè)第312頁(yè)第313頁(yè)第314頁(yè)第315頁(yè)第316頁(yè)第317頁(yè)第318頁(yè)第319頁(yè)第320頁(yè)第321頁(yè)第322頁(yè)第323頁(yè)第324頁(yè)第325頁(yè)第326頁(yè)第327頁(yè)第328頁(yè)第329頁(yè)第330頁(yè)第331頁(yè)第332頁(yè)第333頁(yè)第334頁(yè)第335頁(yè)第336頁(yè)第337頁(yè)第338頁(yè)第339頁(yè)第340頁(yè)第341頁(yè)第342頁(yè)第343頁(yè)第344頁(yè)第345頁(yè)第346頁(yè)第347頁(yè)第348頁(yè)第349頁(yè)第350頁(yè)第351頁(yè)第352頁(yè)第353頁(yè)第354頁(yè)第355頁(yè)第356頁(yè)第357頁(yè)第358頁(yè)第359頁(yè)第360頁(yè)第361頁(yè)第362頁(yè)第363頁(yè)第364頁(yè)第365頁(yè)第366頁(yè)第367頁(yè)第368頁(yè)第369頁(yè)第370頁(yè)第371頁(yè)第372頁(yè)第373頁(yè)第374頁(yè)第375頁(yè)第376頁(yè)第377頁(yè)第378頁(yè)第379頁(yè)第380頁(yè)第381頁(yè)第382頁(yè)第383頁(yè)第384頁(yè)第385頁(yè)第386頁(yè)第387頁(yè)第388頁(yè)第389頁(yè)第390頁(yè)第391頁(yè)第392頁(yè)第393頁(yè)第394頁(yè)第395頁(yè)第396頁(yè)第397頁(yè)第398頁(yè)第399頁(yè)第400頁(yè)第401頁(yè)第402頁(yè)第403頁(yè)第404頁(yè)第405頁(yè)第406頁(yè)第407頁(yè)第408頁(yè)第409頁(yè)第410頁(yè)第411頁(yè)第412頁(yè)第413頁(yè)第414頁(yè)
vi
38B7 Group User’s Manual
List of figures
Fig. 2.4.39 Timing chart (at correct state) of 38B7 Group and M35501FP ...................... 2-127
Fig. 2.4.40 Timing chart (at incorrect state) of 38B7 Group and M35501FP ................... 2-127
Fig. 2.4.41 Setting of relevant registers ................................................................................. 2-128
Fig. 2.4.42 Control procedure ................................................................................................... 2-130
Fig. 2.5.1 Memory assignment of A-D converter relevant registers ................................... 2-133
Fig. 2.5.2 Structure of AD/DA control register ....................................................................... 2-134
Fig. 2.5.3 Structure of A-D conversion register (low-order) ................................................. 2-135
Fig. 2.5.4 Structure of A-D conversion register (high-order) ............................................... 2-135
Fig. 2.5.5 Structure of Interrupt source switch register ........................................................ 2-136
Fig. 2.5.6 Structure of Interrupt request register 2 ............................................................... 2-136
Fig. 2.5.7 Structure of Interrupt control register 2 ................................................................ 2-137
Fig. 2.5.8 Connection diagram ................................................................................................. 2-138
Fig. 2.5.9 Setting of relevant registers ................................................................................... 2-138
Fig. 2.5.10 Control procedure ................................................................................................... 2-139
Fig. 2.6.1 Memory assignment of D-A converter relevant registers ................................... 2-141
Fig. 2.6.2 Structure of D-A conversion register ..................................................................... 2-141
Fig. 2.6.3 Structure of AD/DA control register ....................................................................... 2-142
Fig. 2.6.4 Connection diagram ................................................................................................. 2-143
Fig. 2.6.5 Setting of relevant registers ................................................................................... 2-143
Fig. 2.6.6 Control procedure ..................................................................................................... 2-144
Fig. 2.7.1 Memory assignment of PWM relevant registers .................................................. 2-145
Fig. 2.7.2 Structure of PWM control register ......................................................................... 2-145
Fig. 2.7.3 Structure of PWM register (high-order) ................................................................. 2-146
Fig. 2.7.4 Structure of PWM register (low-order) .................................................................. 2-146
Fig. 2.7.5 Connection diagram ................................................................................................. 2-147
Fig. 2.7.6 Setting of relevant registers ................................................................................... 2-147
Fig. 2.7.7 Control procedure ..................................................................................................... 2-148
Fig. 2.7.8 PWM0 output ............................................................................................................. 2-148
Fig. 2.8.1 Memory assignment of interrupt interval determination function relevant registers
................................................................................................................................... 2-149
Fig. 2.8.2 Structure of Interrupt interval determination register .......................................... 2-149
Fig. 2.8.3 Structure of Interrupt interval determination control register ............................. 2-150
Fig. 2.8.4 Structure of Interrupt edge selection register ...................................................... 2-150
Fig. 2.8.5 Structure of Interrupt request register 1 ............................................................... 2-151
Fig. 2.8.6 Structure of Interrupt control register 1 ................................................................ 2-152
Fig. 2.8.7 Connection diagram ................................................................................................. 2-153
Fig. 2.8.8 Function block diagram ........................................................................................... 2-153
Fig. 2.8.9 Timing chart of data determination ........................................................................ 2-153
Fig. 2.8.10 Setting of relevant registers ................................................................................. 2-154
Fig. 2.8.11 Control procedure ................................................................................................... 2-155
Fig. 2.8.12 Reception of remote-control data (timer 2 interrupt) ........................................ 2-156
Fig. 2.9.1 Memory assignment of watchdog timer relevant register ................................... 2-157
Fig. 2.9.2 Structure of Watchdog timer control register ....................................................... 2-157
Fig. 2.9.3 Structure of CPU mode register ............................................................................ 2-158
Fig. 2.9.4 Connection of watchdog timer and setting of division ratio ............................... 2-159
Fig. 2.9.5 Setting of relevant registers ................................................................................... 2-159
Fig. 2.9.6 Control procedure ..................................................................................................... 2-160
Fig. 2.10.1 Memory assignment of buzzer output circuit relevant register ........................ 2-161
Fig. 2.10.2 Structure of buzzer output control register......................................................... 2-161
Fig. 2.10.3 Connection of buzzer output circuit and setting of division ratio.................... 2-162
Fig. 2.10.4 Setting of relevant register ................................................................................... 2-162
Fig. 2.10.5 Control procedure ................................................................................................... 2-162
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M38B79MFH-XXXXFP | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP100 |
| M38C13M6-XXXFP | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP64 |
| M38C13M6-XXXHP | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP64 |
| M38C59MF-XXXHP | 8-BIT, MROM, 6.25 MHz, MICROCONTROLLER, PQFP80 |
| M38K27M4-XXXHP | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP64 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M38B79MFA053 | 制造商:Panasonic Industrial Company 功能描述:SUB ONLY IC |
| M38C13E6FP | 功能描述:IC 740 MCU OTP 24K 64LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:740/38000 產(chǎn)品培訓(xùn)模塊:MCU Product Line Introduction XMEGA Introduction AVR XMEGA USB Connectivity 標(biāo)準(zhǔn)包裝:90 系列:AVR® XMEGA 核心處理器:AVR 芯體尺寸:8/16-位 速度:32MHz 連通性:I²C，IrDA，SPI，UART/USART 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，DMA，POR，PWM，WDT 輸入/輸出數(shù):50 程序存儲(chǔ)器容量:192KB（96K x 16） 程序存儲(chǔ)器類型:閃存 EEPROM 大小:4K x 8 RAM 容量:16K x 8 電壓 - 電源 (Vcc/Vdd):1.6 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 16x12b; D/A 2x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:64-TQFP 包裝:托盤 配用:ATSTK600-RC14-ND - STK600 SOCKET/ADAPTER 64TQFPATSTK600-TQFP64-ND - STK600 SOCKET/ADAPTER 64-TQFPATAVRONEKIT-ND - KIT AVR/AVR32 DEBUGGER/PROGRMMRATAVRISP2-ND - PROGRAMMER AVR IN SYSTEM |
| M38C13E6HP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| M38C13RLFS | 制造商:Renesas Electronics Corporation 功能描述:EMULATION MCU/8BIT CMOS EMULATION CHIP - Bulk |
| M38C24M4-XXXFP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。