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參數(shù)資料
| 型號： | M30240M6-XXXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, OTPROM, MICROCONTROLLER, PQFP80 |
| 封裝： | 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件頁數(shù)： | 255/380頁 |
| 文件大?。?/td> | 4328K |
| 代理商： | M30240M6-XXXXFP |
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Universal Serial Bus
M30240 Group
Rev.1.00 Sep 24, 2003 Page 310 of 360
3.2.3.1 Transmission Precautions
The number of data packets in the IN FIFO should be determined from the IN_PKT_RDY bit and the
TX_NOT_EPT flag. If there are two data packets in the IN FIFO (double buffer mode), the
IN_PKT_RDY bit is cleared to “0” at the completion of the transmission even if one data packet re-
mains in the IN FIFO.
Also, it is possible to flush data from the IN FIFO by setting the FLUSH bit to “1.” The oldest data pack-
et is flushed out if there are two or more data packets.
3.2.4 USB Receive
Each of the Endpoints 0-4 has a separate OUT (receive) FIFO. The endpoint’s OUT FIFO structure is:
Endpoint 0: 32 bytes
Endpoint 1: 128 bytes
Endpoint 2: 32 bytes
Endpoint 3: 32 bytes
Endpoint 4: 32 bytes
The USB Endpoint x(x = 0-4) OUT FIFO data are read as it is received. By reading the data, the internal
FIFO write pointer is automatically decremented by 1. The value of the internal write pointer cannot be
read.
When Endpoint 0 Is Used:
After a data packet has been received, the OUT_PKT_RDY flag is set to “1,” the received packet size
is set in the USB Endpoint 0 OUT Write Count register (031516). After the data are read from the OUT
F I F O , the O U T _ PKT _R DY f l ag shou ld b e cle a red to “0” by writ ing a “1” to the
SERVICED_OUT_PKT_RDY bit.
When the last data packet has been read from the OUT FIFO, the DATA_END bit should be set to “1“at
the same time. When DATA_END is set to “1”, the USB Function Control unit proceeds to the next
status phase. The FCU clears this bit to “0” when the status phase completes.
When Endpoint 1-4 Is Used:
After a data packet is received, the OUT_PKT_RDY flag is set to “1,” and the received packet size is
set in the Endpoint x (x=1-4) OUT write count register (Addresses 031D16, 032516, 032D16 and
033516).
If the AUTO_CLR bit is “1,” the OUT_PKT_RDY flag is cleared automatically to “0” after the number of
data bytes equal to the MaxP OUT size is read.
If the AUTO_CLR bit is “0,” the OUT_PKT_RDY flag should be cleared by writing a “0” to it after the
data has been read from the OUT FIFO.
3.2.4.1 Receiving Precautions
For Endpoints 1-4:
When there are more than one data packet in the OUT FIFO, the OUT_PKT_RDY flag will not be set
to “0” until the FIFO is empty, even after writing a “0” to it when a packet is unloaded.
Table 3.6:
IN FIFO Status
IN_PKT_RDY
TX_NOT_EPT
IN FIFO Status
0
No data packet
01
1 data packet in IN FIFO if MAXP,+ half of the FIFO size.
Invalid when MAXP > half of the FIFO size.
10
Invalid
11
2 data packets in IN FIFO when MAXP <= half of the FIFO size.
1 data packet in IN FIFO when MAXP > half of the FIFO size.
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PDF描述 |
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