參數(shù)資料
型號： MPC823ZT25
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, RISC PROCESSOR, PBGA256
封裝： 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256
文件頁數(shù)： 161/1407頁
文件大?。?/td> 13074K
代理商： MPC823ZT25
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Development Capabilities and Interface
MOTOROLA
MPC823 USER’S MANUAL
20-29
DEVELOPMENT
20
CAPABILITIES
&
INTERFACE
20.4.3 The Development Interface Port
The development port provides a full-duplex serial interface for communications between
the internal development support logic and an external development tool. The relationship
of the development support logic to the rest of the core is illustrated in Figure 20-5. Notice
that the development port support logic is shown as a separate block for clarity. It will be
implemented as part of the system interface unit module. The development interface port
contains the four pins:
Development serial clock
Development serial data in
Development serial data out
Freeze
20.4.3.1 DEVELOPMENT SERIAL CLOCK. The development serial clock (DSCK) pin is
used to shift data into and out of the development interface port shift register. At the same
time, the new most-significant bit of the shift register is presented to the development serial
data out (DSDO) pin. Future references to the DSCK signal imply the internally
synchronized value of the clock. The DSCK input must be driven either high or low at all
times and it not allowed to float. With a resistor, a typical target environment would pull this
input low.
The clock can be implemented as a free-running or gated clock. The shifting of data is
controlled by the ready and start signals, so the clock does not need to be gated with the
serial transmissions. The DSCK pin is used at reset to enable debug mode either
immediately following reset or to enter debug mode driving an event.
20.4.3.2 DEVELOPMENT SERIAL DATA IN. Data to be transferred into the development
interface port shift register is presented to the development serial data in (DSDI) pin by
external logic. When driven asynchronous with the system clock, the data presented to the
DSDI pin must be stable at setup time before the rising edge of DSCK and at hold time after
the rising edge of DSCK. When synchronously driven to the system clock, the data must be
stable on DSDI or a setup time before system clock output (CLKOUT) rising edge and a hold
time after the rising edge of CLKOUT. The DSDI pin is also used at reset to control the
overall chip configuration mode and determine the development port clock mode. Refer to
20.4.3.3 DEVELOPMENT SERIAL DATA OUT. The debug mode logic shifts data out of
the development interface port shift register using the development serial data out (DSDO)
pin. All transitions on DSDO are synchronous with DSCK or CLKOUT, depending on the
clock mode. Data will be valid at setup time before the rising edge of the clock and remains
valid at hold time after the rising edge of the clock. See Table 20-10 for details about DSDO
data.
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MPC8241LVR200X 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR166X 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LVR266D 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357
MPC8241LZQ166D 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
MPC8241LZP166B 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357
相關(guān)代理商/技術(shù)參數(shù)
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MPC8240 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8240EC 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications
MPC8241 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications
MPC8241EC 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications
MPC8241LVR166D 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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