參數(shù)資料
型號： LTC4214-1IMS#TRPBF
廠商： Linear Technology
文件頁數(shù)： 28/32頁
文件大?。?/td> 277K
描述： IC CTRLR HOTSWAP NEGVOLT 10MSOP
標(biāo)準(zhǔn)包裝： 2,500
類型： 熱交換控制器
應(yīng)用： 通用
內(nèi)部開關(guān)： 無
電源電壓： 6 V ~ 16 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應(yīng)商設(shè)備封裝： 10-MSOP
包裝： 帶卷 (TR)
LTC4214-1/LTC4214-2
28
421412f
APPLICATIO  S I FOR  ATIO
U
U
U
Figure 16. Current Limit Behavior (All Waveforms are Referenced to V
EE
)
(16a) Analog Current Limit Fault
(16b) Fast Current Limit Fault
Analog Current Limit and Fast Current Limit
In Figure 16a, when SENSE exceeds V
ACL
, GATE is regu-
lated by the analog current limit amplifier loop. When
SENSE drops below V
ACL
, GATE is allowed to pull up. In
Figure 16b, when a severe fault occurs, SENSE exceeds
V
FCL
 and GATE immediately pulls down until the analog
current amplifier can establish control. If the severe fault
causes V
OUT
to exceed V
DRNCL
, the DRAIN pin is clamped
at V
DRNCL
. I
DRN
 flows into the DRAIN pin and is multiplied
by 8. This extra current is added to the TIMER pull-up
current of 40礎(chǔ). This accelerated TIMER current of
[40礎(chǔ)+8 " I
DRN
] produces a shorter circuit breaker fault
delay. Careful selection of C
T
, R
D
 and MOSFET can help
prevent SOA damage in a low impedance fault condition.
TIMER
GATE
SENSE
V
OUT
V
ACL
V
CB
SS
DRAIN
V
TMRH
40礎(chǔ) + 8 " I
DRN
4214 F16
PWRGD
5礎(chǔ)
5礎(chǔ)
TIMER
GATE
SENSE
V
OUT
V
ACL
V
CB
V
FCL
SS
DRAIN
V
TMRH
V
DRNCL
40礎(chǔ) + 8 " I
DRN
PWRGD
1
2
1
4
3
2
CB TIMES OUT
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PDF描述
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參數(shù)描述
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