參數資料
型號： LTC4214-1IMS#TRPBF
廠商： Linear Technology
文件頁數： 20/32頁
文件大?。?/td> 277K
描述： IC CTRLR HOTSWAP NEGVOLT 10MSOP
標準包裝： 2,500
類型： 熱交換控制器
應用： 通用
內部開關： 無
電源電壓： 6 V ~ 16 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 10-TFSOP，10-MSOP（0.118"，3.00mm 寬）
供應商設備封裝： 10-MSOP
包裝： 帶卷 (TR)
LTC4214-1/LTC4214-2
20
421412f
APPLICATIO  S I FOR  ATIO
U
U
U
GND  (12V)
UV/OV
V
IN
TIMER
GATE
V
LKO
SENSE
V
IN
 CLEARS V
LKO
, CHECK UV > V
UVHI
, OV < V
OVHI
, GATE < V
GATEL
, SENSE < V
CB
, SS < 20 " V
OS
 AND TIMER < V
TMRL
V
OUT
1   2
3 4 56    7   8
V
ACL
V
CB
9
TIMER CLEARS V
TMRL
, CHECK GATE < V
GATEL
, SENSE < V
CB
 AND SS < 20 " V
OS
SS
DRAIN
PWRGD
40礎 + 8 " I
DRN
5礎
20 " V
OS
50礎
1011
V
IN
  V
GATEH
V
DRNL
V
DRNCL
20 " (V
CB
 + V
OS
)
20 " (V
ACL
 + V
OS
)
V
GATEL
V
TMRL
V
TMRH
5礎
5礎
50礎
4214 F08
GATE
START-UP
INITIAL TIMING
Figure 8. System Power-Up Timing (All Waveforms are Referenced to V
EE
)
the load current. If the SENSE voltage (V
SENSE
  V
EE
)
reaches the V
CB
 threshold at time point 7, the circuit
breaker TIMER activates. The TIMER capacitor, C
T
, is
charged by a (40礎 + 8 " I
DRN
) current pull-up. As the load
capacitor nears full charge, load current begins to decline.
At time point 8, the load current falls and the SENSE
voltage drops below V
ACL
(t). The analog current limit loop
shuts off and the GATE pin ramps further. At time point 9,
the SENSE voltage drops below V
CB
, the fault TIMER cycle
ends, followed by a 5礎 discharge cycle (cool off). The
duration between time points 7 and 9 must be shorter than
one circuit breaker delay to avoid a fault time out during
GATE ramp-up. When GATE ramps past the V
GATEH
 thresh-
old at time point 10, PWRGD pulls low. At time point 11,
GATE reaches its maximum voltage as determined by V
IN
.
Live Insertion with Short Pin Control of UV/OV
In the example shown in Figure 9, power is delivered
through long connector pins whereas the UV/OV divider
makes contact through a short pin. This ensures the power
connections are firmly established before the LTC4214 is
activated. At time point 1, the power pins make contact and
V
IN
 ramps through V
LKO
. At time point 2, the UV/OV divider
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