參數(shù)資料
型號(hào)： LFEC6E-5F484C
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
英文描述： 30V N-Channel PowerTrench MOSFET
中文描述： FPGA, 768 CLBS, 6100 GATES, 420 MHz, PBGA484
封裝： 23 X 23 MM, FPBGA-484
文件頁(yè)數(shù)： 7/117頁(yè)
文件大小： 557K
代理商： LFEC6E-5F484C
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2-4
Architecture
Lattice Semiconductor
LatticeECP/EC Family Data Sheet
Figure 2-4. Slice Diagram
Table 2-1. Slice Signal Descriptions
Function
Input
Input
Input
Input
Input
Input
Input
Input
Output
Output
Output
Output
Output
1. See Figure 2-3 for connection details.
2. Requires two PFUs.
Type
Signal Names
A0, B0, C0, D0 Inputs to LUT4
A1, B1, C1, D1 Inputs to LUT4
M0
M1
CE
LSR
CLK
FCIN
F0, F1
Q0, Q1
OFX0
OFX1
FCO
Description
Data signal
Data signal
Multi-purpose
Multi-purpose
Control signal
Control signal
Control signal
Inter-PFU signal
Data signals
Data signals
Data signals
Data signals
Inter-PFU signal
Multipurpose Input
Multipurpose Input
Clock Enable
Local Set/Reset
System Clock
Fast Carry In
LUT4 output register bypass signals
Register Outputs
Output of a LUT5 MUX
Output of a LUT6, LUT7, LUT8
For the right most PFU the fast carry chain output
1
2
MUX depending on the slice
1
LUT4 &
CARRY
LUT4 &
CARRY
Slice
A0
B0
C0
D0
FF/
Latch
OFX0
F0
Q0
A1
B1
C1
D1
CI
CI
CO
CO
F
SUM
CE
CLK
LSR
FF/
Latch
OFX1
F1
Q1
F
SUM
D
D
M1
M0
To / From
Different slice / PFU
To / From
Different slice / PFU
LUT
Expansion
Mux
OFX0
From
Routing
To
Routing
Control Signals
selected and
inverted per
slice in routing
Interslice signals
are not shown
相關(guān)PDF資料
PDF描述
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