- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377633 > LFEC6E-5F484C (LATTICE SEMICONDUCTOR CORP) 30V N-Channel PowerTrench MOSFET PDF資料下載
參數(shù)資料
| 型號： | LFEC6E-5F484C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | FPGA |
| 英文描述： | 30V N-Channel PowerTrench MOSFET |
| 中文描述： | FPGA, 768 CLBS, 6100 GATES, 420 MHz, PBGA484 |
| 封裝： | 23 X 23 MM, FPBGA-484 |
| 文件頁數(shù)： | 33/117頁 |
| 文件大?。?/td> | 557K |
| 代理商： | LFEC6E-5F484C |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁當前第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁
2-30
Architecture
Lattice Semiconductor
LatticeECP/EC Family Data Sheet
options for drive strength, bus maintenance (weak pull-up, weak pull-down, or a bus-keeper latch) and open drain.
Other single-ended standards supported include SSTL and HSTL. Differential standards supported include LVDS,
BLVDS, LVPECL, RSDS, differential SSTL and differential HSTL. Tables 2-13 and 2-14 show the I/O standards
(together with their supply and reference voltages) supported by the LatticeECP/EC devices. For further informa-
tion on utilizing the sysIO buffer to support a variety of standards please see the details of additional technical infor-
mation at the end of this data sheet.
Table 2-13. Supported Input Standards
Input Standard
V
REF
(Nom.)
V
CCIO
1
(Nom.)
Single Ended Interfaces
LVTTL
LVCMOS33
2
LVCMOS25
2
LVCMOS18
LVCMOS15
LVCMOS12
2
PCI
HSTL18 Class I, II
HSTL18 Class III
HSTL15 Class I
HSTL15 Class III
SSTL3 Class I, II
SSTL2 Class I, II
SSTL18 Class I
Differential Interfaces
Differential SSTL18 Class I
Differential SSTL2 Class I, II
Differential SSTL3 Class I, II
Differential HSTL15 Class I, III
Differential HSTL18 Class I, II, III
LVDS, LVPECL, BLVDS, RSDS
1. When not speci
fi
ed V
CCIO
can be set anywhere in the valid operating range.
2. JTAG inputs do not have a
fi
xed threshold option and always follow V
CCJ.
—
—
—
—
—
—
—
0.9
1.08
0.75
0.9
1.5
1.25
0.9
—
—
—
1.8
1.5
—
3.3
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
相關PDF資料 |
PDF描述 |
|---|---|
| LFEC6E-5F484I | Octal D-type Edge-Triggered Flip-Flops With 3-State Outputs 20-TVSOP -40 to 85 |
| LFEC6E-5F900I | Octal D-type Edge-Triggered Flip-Flops With 3-State Outputs 20-TVSOP -40 to 85 |
| LFEC6E-5T100C | Octal D-type Edge-Triggered Flip-Flops With 3-State Outputs 20-TVSOP -40 to 85 |
| LFEC6E-5T100I | Octal D-type Edge-Triggered Flip-Flops With 3-State Outputs 20-SOIC -40 to 85 |
| LFECP33E-4F256I | 12-Bit, 400 kSPS ADC, Serial Out, TMS320 Compatible (up to 10MHz), Single Ch. Pseudo-differential 8-SOIC -40 to 85 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| LFEC6E-5F484I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5F672C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5F672I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5F900C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5F900I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
發(fā)布緊急采購，3分鐘左右您將得到回復。