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參數(shù)資料
| 型號： | L64704 |
| 廠商： | LSI Corporation |
| 英文描述： | Satellite Decoder Which Contains A BPSK/QPSK Demodulator And A Concatenated FEC Decoder(衛(wèi)星信號譯碼器（包含BPSK/QPSK 解調器和FEC解碼器）) |
| 中文描述： | 衛(wèi)星解碼器，其中載有的BPSK / QPSK調制解調器和FEC解碼器級聯(lián)（衛(wèi)星信號譯碼器（包含的BPSK / QPSK調制解調器和前向糾錯解碼器）） |
| 文件頁數(shù)： | 71/220頁 |
| 文件大小： | 1640K |
| 代理商： | L64704 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁當前第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁
Group 4 Registers
3-39
3.6.14
Group 4,
APR 15
Clock Loop
Control 2
The Clock Loop Control 2 register is used to set clock parameters related
to the Demodulator module Automatic Frequency Control (AFC) and
external phase-locked loop. It also contains the power-down control bit.
Read/Write: R/W
Set to 0
Set to 0
You should set this bit to 0 for proper operation.
7
PCLK_BP
PCLK Bypass
When you set this bit to 0, the PCLK output pin carries
the clock signal generated by the internal PLL module.
When you set this bit to 1, PCLK presents SCLK at the
output and bypasses the internal PLL module. For a block
diagram see Section
4.1, “Data Control and Clocking
Schemes.”
6
Set to 0
Set to 0
You should set this bit to 0 for proper operation.
5
PD
Power-Down
When you set Power-Down to 1, all modules except the
asynchronous microprocessor interface are turned off to
reduce power consumption to a minimum. No data pro-
cessing can occur during Power-Down. When you set
Power-Down to 0 all elements operate. You should apply
a reset pulse after you change Power-Down from 1 to 0
(wake-up) before you start processing data.
4
D1 D0
Decimation
Oversampling
Ratio
0
0
1
1
0
1
0
1
none
1/2
2/3
Illegal
2
4
3
APR
D7
D6
D5
D4
D3
D2
D1
D0
15
Set to 0
PCLK_
BP
Set to 0
PD
CLK_RP[3:0]
Definition
D4
Normal Operation
Device in Power-Down Mode
0
1
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PDF描述 |
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參數(shù)描述 |
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| L6470HTR | 功能描述:馬達/運動/點火控制器和驅動器 8 - 45V 7.0A Bipolar dSPIN MicroStepping RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube |
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| L6470PDTR | 功能描述:馬達/運動/點火控制器和驅動器 dSPIN 7.0A 8 - 45 V DMOS Motor Driver RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube |
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