參數(shù)資料
型號(hào): L64704
廠商: LSI Corporation
英文描述: Satellite Decoder Which Contains A BPSK/QPSK Demodulator And A Concatenated FEC Decoder(衛(wèi)星信號(hào)譯碼器(包含BPSK/QPSK 解調(diào)器和FEC解碼器))
中文描述: 衛(wèi)星解碼器,其中載有的BPSK / QPSK調(diào)制解調(diào)器和FEC解碼器級(jí)聯(lián)(衛(wèi)星信號(hào)譯碼器(包含的BPSK / QPSK調(diào)制解調(diào)器和前向糾錯(cuò)解碼器))
文件頁數(shù): 124/220頁
文件大小: 1640K
代理商: L64704
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5-20
Demodulator Module Functional Description
The loop filter output is provided with two
Σ
modulated complementary
signal pairs, CAR_VCO1P and CAR_VCO1N, and AR_VCO2P and
CAR_VCO2N. These signals connect to the external active integrator,
that completes the loop filter chain (
Figure 5.8
). One of the complemen-
tary pairs is selected while the other is 3-stated, depending on the set-
tings of the CAR_VCO1N/P and CAR_VCO2N/P bits (Group 4, APR 33).
After reset, both complementary pairs are active. Externally, these
signals are added together in the analog integrator. The CAR_VCO2P/N
outputs should be weighted with a different factor with respect to the
CAR_VCO1P/N outputs by proper selection of the corresponding resis-
tors and capacitors. With two pairs of loop-filter outputs, you can adjust
the loop bandwidth over a large range of data rates by enabling one or
the other of the output pairs.
5.6.2.3 Low Baud Rate Operation
For low-baud-rate operation (between one and five Mbaud), the Sigma-
Delta conversion used in the carrier loop introduces a delay that makes
the carrier loop too narrow for reliable operation.
For this type of application, program the CAR_OUT_SEL bit (Group 4,
APR 33) so that the L64704 Carrier Loop pins carry the Phase Error
Detector to DAC (CAR_PED[5:0]) outputs instead of the CAR_VCOxP/N
outputs. The CAR_PED signal is simply the digital signal before Sigma-
Delta conversion. It is intended to be connected to an external 6-bit DAC,
that then feeds a similar active low-pass filter as described previously.
You program the L64704 to output the SCLK signal on the DVALIDOUT
pin by setting the SYNC/SCLK bit (Group 4, APR 14) to 1. The SCLK
signal on the DVALIDOUT pin is used to clock the external DAC.
You should set the CAR_PED_SEL bit to 1 to enable the CAR_PED[5:0]
outputs. You also need to feed the voltage level from the DAC’s output to
a loop filter similar to one of the filters shown in
Figure 5.10
.
For low bit rate applications that use an external DAC, you must enable
both Sigma-Delta outputs by setting Carrier Loop Configuration Register
(Group 4, APR 33) bits [5:4] to zero.
The output of the DAC interface, CAR_PED[5:0] is in offset binary format.
A value of ‘000000’ produces a decrease in the VCO control voltage. A
value of ‘111111’ produces an increase in the VCO control voltage. The
value ‘100000’ is the zero control voltage.
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參數(shù)描述
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L6470HTR 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 8 - 45V 7.0A Bipolar dSPIN MicroStepping RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube
L6470HTR-CUT TAPE 制造商:ST 功能描述:L6470H Series 45 V Quad Output dSPIN Microstepping Motor Driver - HTSSOP-28
L6470PD 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 dSPIN 7.0A 8 - 45 V DMOS Motor Driver RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube
L6470PDTR 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 dSPIN 7.0A 8 - 45 V DMOS Motor Driver RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube