- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64704 (LSI Corporation) Satellite Decoder Which Contains A BPSK/QPSK Demodulator And A Concatenated FEC Decoder(衛(wèi)星信號(hào)譯碼器（包含BPSK/QPSK 解調(diào)器和FEC解碼器）) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64704 |
| 廠商： | LSI Corporation |
| 英文描述： | Satellite Decoder Which Contains A BPSK/QPSK Demodulator And A Concatenated FEC Decoder(衛(wèi)星信號(hào)譯碼器（包含BPSK/QPSK 解調(diào)器和FEC解碼器）) |
| 中文描述： | 衛(wèi)星解碼器，其中載有的BPSK / QPSK調(diào)制解調(diào)器和FEC解碼器級(jí)聯(lián)（衛(wèi)星信號(hào)譯碼器（包含的BPSK / QPSK調(diào)制解調(diào)器和前向糾錯(cuò)解碼器）） |
| 文件頁數(shù)： | 109/220頁 |
| 文件大?。?/td> | 1640K |
| 代理商： | L64704 |
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Channel Clock Recovery
5-5
5.5.1
Input
Decimation
The CLK_RATIO[2:0] bits (Group 4, APR 18) set the ratio of the VCO
clock to the required sample clock in the L64704. For example, if the
input signal is 5-Mbaud and the oversampling ratio is N = 4, then the
input sample frequency is 20 MHz. Under the same conditions, it is pos-
sible to use a VCO running at 40 MHz by specifying CLK_RATIO = 1.
This corresponds to an input decimation of 2, and in this case every
second sample coming from the ADC is fed to the L64704.
This feature allows the satellite decoder control program to choose a
reduced VCO range when the L64704 must operate over a wide range
of baud rates. Note that setting the CLK_RATIO bits does not switch any
decimation filters in the data path; therefore the external IF SAW filtering
must fit the baud rate and the oversampling ratio selected via the
CLK_DR bits (Group 4, APR 14).
5.5.2
Clock
Acquisition and
Tracking Modes
The Clock Synchronizer operates in two modes:
Clock Acquisition
Tracking
5.5.2.1 Clock Acquisition Mode
In the acquisition mode (indicated by CLK_LCF = 0; Group 3, APR 9),
the Automatic Frequency Controller (AFC) is active but the Timing Error
Detector (TED) is not. Software can disable the AFC after the Clock
Synchronizer completes acquisition of the timing loop. This prevents the
system from switching back to acquisition mode if a short interrupt
occurs during transmission. Setting the CLK_LCF_SUPPRESS bit
(Group 4, APR 14) disables the AFC.
The AFC control function determines whether the VCO clock is within the
pull-in range of the L64704. If the VCO clock is within the pull-in range,
the CLK_LCF bit is set to 1. If the VCO clock is too slow, then the AFC
drives a positive voltage on the loop output in order to generate a positive
frequency sweep. If the VCO clock is too fast, then the AFC drives a low
voltage on the loop output in order to generate a negative frequency
sweep.
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PDF描述 |
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參數(shù)描述 |
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| L6470HTR | 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 8 - 45V 7.0A Bipolar dSPIN MicroStepping RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube |
| L6470HTR-CUT TAPE | 制造商:ST 功能描述:L6470H Series 45 V Quad Output dSPIN Microstepping Motor Driver - HTSSOP-28 |
| L6470PD | 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 dSPIN 7.0A 8 - 45 V DMOS Motor Driver RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube |
| L6470PDTR | 功能描述:馬達(dá)/運(yùn)動(dòng)/點(diǎn)火控制器和驅(qū)動(dòng)器 dSPIN 7.0A 8 - 45 V DMOS Motor Driver RoHS:否 制造商:STMicroelectronics 產(chǎn)品:Stepper Motor Controllers / Drivers 類型:2 Phase Stepper Motor Driver 工作電源電壓:8 V to 45 V 電源電流:0.5 mA 工作溫度:- 25 C to + 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:HTSSOP-28 封裝:Tube |
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