參數(shù)資料
型號： ISP1583ET2
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： UNIVERSAL SERIAL BUS CONTROLLER, PBGA64
封裝： 6 X 6 MM, 0.80 MM HEIGHT, LEAD FREE, PLASTIC, MO-195, SOT543-1,TFBGA-64
文件頁數(shù)： 75/100頁
文件大?。?/td> 508K
代理商： ISP1583ET2
ISP1583_7
NXP B.V. 2008. All rights reserved.
Product data sheet
Rev. 07 — 22 September 2008
75 of 99
NXP Semiconductors
ISP1583
Hi-Speed USB peripheral controller
13.1.2.2
A0 function
8051 mode
BUS_CONF/DA0 = LOW: split bus mode
MODE1 = HIGH: A0 function
– MODE0/DA1 = HIGH: 8051 mode; see Table 3
Fig 27. ISP1583 register access timing: multiplexed address/data bus (Freescale mode)
address
data
(write) AD[7:0]
ALE/A0
(read) AD[7:0]
004aaa381
RW_N/RD_N
DS_N/WR_N
CS_N
Tcy(RW)
tWHSH
tWHDZ
tDVWH
tI1VLL
tLLI2L
tWLWH
tI2HI1X
Table 106. ISP1583 register access timing parameters: multiplexed address/data bus
VCC(I/O) = 1.65 V to 3.6 V; VCC(3V3) = 3.3 V; VGND = 0 V; Tamb = 40 °C to +85 °C; unless otherwise specied.
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
Reading
tRLDV
RW_N/RD_N LOW to data valid delay
-
26
ns
tRHDZ
RW_N/RD_N HIGH to data outputs 3-state delay
0
-
15
ns
tRHSH
RW_N/RD_N HIGH to CS_N HIGH delay
0
-
ns
tRLRH
RW_N/RD_N LOW pulse width
> tRLDV
--ns
tWHRH
DS_N/WR_N HIGH to RW_N/RD_N HIGH delay
40
-
ns
Writing
tA0WL
ALE/A0 set-up time before DS_N/WR_N LOW
0
-
ns
tAVWH
address set-up time before DS_N/WR_N HIGH
5
-
ns
tDVWH
data set-up time before DS_N/WR_N HIGH
5
-
ns
tWHDZ
data hold time after DS_N/WR_N HIGH
5
-
ns
tWHSH
DS_N/WR_N HIGH to CS_N HIGH delay
0
-
ns
tWLWH
DS_N/WR_N LOW pulse width
15
-
ns
相關PDF資料
PDF描述
ISP1761ET,518 UNIVERSAL SERIAL BUS CONTROLLER, PBGA128
ISP1761BE,518 UNIVERSAL SERIAL BUS CONTROLLER, PQFP128
ISP1761BE,551 UNIVERSAL SERIAL BUS CONTROLLER, PQFP128
ISP1761BE,518 UNIVERSAL SERIAL BUS CONTROLLER, PQFP128
ITR8307 SPECIALTY OPTOELECTRONIC DEVICE
相關代理商/技術參數(shù)
參數(shù)描述
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ISP1583ET-T 功能描述:外圍驅動器與原件 - PCI HI-SPEED USB2 DEVICE RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray
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