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參數資料
| 型號： | IDT82V2108BBG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 68/292頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER T1/J1/E1 8CH 144-BGA |
| 標準包裝： | 10 |
| 控制器類型： | T1/E1/J1 調幀器 |
| 接口： | 并聯 |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 電流 - 電源： | 160mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-BGA |
| 供應商設備封裝： | 144-PBGA（13x13） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2108BBG |
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Pin Description
6
March 5, 2009
2
PIN DESCRIPTION
Name
Type
Pin No.
Description
PQFP PBGA
Line and System Interface
LRD[1]
LRD[2]
LRD[3]
LRD[4]
LRD[5]
LRD[6]
LRD[7]
LRD[8]
Input
1
3
5
7
31
33
35
37
A2
B2
A1
B1
J4
L1
L2
M1
LRD[1:8]: Line Receive Data for Framer 1 ~ 8
These pins receive the data stream from line interface units or from a higher demultiplex interface. Data on these
pins are sampled on the active edge of the corresponding LRCKn.
LRCK[1]
LRCK[2]
LRCK[3]
LRCK[4]
LRCK[5]
LRCK[6]
LRCK[7]
LRCK[8]
Input
2
4
6
8
32
34
36
38
C3
D3
C2
E4
K2
K3
K4
L3
LRCK[1:8]: Line Receive Clock for Framer 1 ~ 8
These pins receive externally recovered line clock (2.048 or 1.544 MHz). The clock is used to sample the data on
the corresponding LRDn.
RSCK[1] / RSSIG[1] /
MRSSIG[1]
RSCK[2] / RSSIG[2] /
MRSSIG[2]
RSCK[3] / RSSIG[3]
RSCK[4] / RSSIG[4]
RSCK[5] / RSSIG[5]
RSCK[6] / RSSIG[6]
RSCK[7] / RSSIG[7]
RSCK[8] / RSSIG[8]
Output
96
91
88
83
80
77
72
69
C11
D12
E12
G11
H11
G9
H9
M12
RSCK[1:8]: Receive Side System Clock for Framer 1 ~ 8
In Receive Clock Master Full E1 or T1/J1 mode, the clock is a smoothed version of the corresponding 2.048 or
1.544 MHz Line Receive Clock (LRCKn). The RSCKn is pulsed for each bit in the 256-bit or 193-bit frame. The cor-
responding RSFSn and RSDn pins are updated on the active edge of RSCKn.
In Receive Clock Master Nx64K mode, the clock is a gapped version of the associated smoothed LRCKn. The
pulse number of RSCKn in each frame is controllable from 0 to 255 or from 0 to 192 on a per-timeslot/channel
basis. The corresponding RSFSn and RSDn pins are updated on the active edge of RSCKn.
In Receive Clock Slave RSCK Reference mode, RSCKn can be selected to be either a 2.048/1.544 MHz jitter atten-
uated version of the corresponding LRCKn or an 8KHz clock divided down from the smoothed line clock LRCKn.
RSSIG[1:8]: Receive Side System Signaling for Framer 1 ~ 8
In Receive Clock Slave External Signaling mode, the extracted signaling is output on these pins. The signal on
these pins is timeslot/channel-aligned with the data output on the corresponding RSDn pin and is updated on the
active edge of RSCCK. The extracted signaling is located in the lower nibble (b5 ~ b8). In E1 mode, the extracted
signaling repeats during the entire Signaling Multi-Frame for the same time slot. In T1/J1 mode, the extracted sig-
naling repeats during the entire SF/ESF for the same channel.
MRSSIG[1:2]: Multiplexed Receive Side System Signaling
When the multiplexed bus structure is configured, the extracted signaling data from the selected framers are multi-
plexed on these pins using a byte-interleaved multiplexing scheme. The data on MRSSIG[1:2] are updated on the
active edge of MRSCCK.
RSD[1] / MRSD[1]
RSD[2] / MRSD[2]
RSD[3]
RSD[4]
RSD[5]
RSD[6]
RSD[7]
RSD[8]
Output
97
94
89
84
81
78
73
70
B12
C12
E10
F12
F9
G10
J11
K11
RSD[1:8]: Receive Side System Data for Framer 1 ~ 8
The processed data stream is output on these pins.
In Receive Clock Master mode, RSDn is updated on the active edge of the corresponding RSCKn.
In Receive Clock Slave mode, RSDn is updated on the active edge of RSCCK.
MRSD[1:2]: Multiplexed Receive Side System Data
When the multiplexed bus structure is configured, the processed data stream from the selected framers is multi-
plexed on these pins using the byte-interleaved multiplexing scheme. The data on MRSD[1:2] are updated on the
active edge of MRSCCK.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT82V2604BBG | IC INVERSE MUX 4CH ATM 208-BGA |
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| IDT82V2616BBG | IC INVERSE MUX 16CH ATM 272-PBGA |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| IDT82V2604 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:INVERSE MULTIPLEXING FOR ATM IDT82V2604 |
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