參數(shù)資料
型號(hào)： IDT82V2108BBG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 151/292頁
文件大?。?/td> 0K
描述： IC FRAMER T1/J1/E1 8CH 144-BGA
標(biāo)準(zhǔn)包裝： 10
控制器類型： T1/E1/J1 調(diào)幀器
接口： 并聯(lián)
電源電壓： 2.97 V ~ 3.63 V
電流 - 電源： 160mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-BGA
供應(yīng)商設(shè)備封裝： 144-PBGA（13x13）
包裝： 托盤
其它名稱： 82V2108BBG
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Programming Information
224
March 5, 2009
T1 / J1 TJAT Configuration (01BH, 09BH, 11BH, 19BH, 21BH, 29BH, 31BH, 39BH)
CENT:
The CENT allows the TJAT FIFO to self-center its read pointer, maintaining the pointer at least 4 UI away from the FIFO being empty or full.
= 0: Disable the self-center. Data passes through uncorrupted when the FIFO is empty or full.
= 1: Enable the FIFO to self-center its read pointer when the FIFO is 4 UI away from being empty or full.
A positive transition in this bit will execute a self-center action immediately.
UNDE:
This bit decides whether to generate an interrupt when the TJAT FIFO is under-run.
= 0: No interrupt is generated when the TJAT FIFO is under-run.
= 1: An interrupt on the INT pin is generated when the TJAT FIFO is under-run.
OVRE:
This bit decides whether to generate an interrupt when the TJAT FIFO is overwritten.
= 0: No interrupt is generated when the TJAT FIFO is overwritten.
= 1: An interrupt on the INT pin is generated when the TJAT FIFO is overwritten.
LIMIT:
= 0: Disable the limitation of the jitter attenuation.
= 1: Enable the DPLL to limit the jitter attenuation by enabling the FIFO to increase or decrease the frequency of the output smoothed clock when
the read pointer is 1 UI away from the FIFO being empty or full. This limitation of jitter attenuation ensures that no data is lost during high phase shift
conditions.
T1 / J1 ELSB Interrupt Enable / Status (01DH, 09DH, 11DH, 19DH, 21DH, 29DH, 31DH, 39DH)
SLIPE:
= 0: Disable the interrupt on the INT pin when a slip occurs.
= 1: Enable the interrupt on the INT pin when a slip occurs.
SLIPD:
This bit is valid when the SLIPI is logic 1.
= 0: The latest slip is due to the Elastic Store Buffer being empty; a frame was duplicated.
= 1: The latest slip is due to the Elastic Store Buffer being full; a frame was deleted.
SLIPI:
= 0: No slip occurs.
= 1: A slip occurs.
This bit is cleared to ‘0’ after the bit is read.
Bit No.
7
6
5
4
3
2
1
0
Bit Name
Reserved
CENT
UNDE
OVRE
Reserved
LIMIT
Type
R/W
Default
00
0
1
Bit No.
7
6
5
4
3
2
1
0
Bit Name
Reserved
SLIPE
SLIPD
SLIPI
Type
R/W
R
Default
0X
X
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PDF描述
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IDT82V2108PX8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A
IDT82V2108PXG 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A
IDT82V2108PXG8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標(biāo)準(zhǔn)包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A
IDT82V2604 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:INVERSE MULTIPLEXING FOR ATM IDT82V2604
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