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參數(shù)資料
| 型號： | IDT82V2108BBG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 66/292頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER T1/J1/E1 8CH 144-BGA |
| 標準包裝： | 10 |
| 控制器類型： | T1/E1/J1 調幀器 |
| 接口： | 并聯(lián) |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 電流 - 電源： | 160mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-BGA |
| 供應商設備封裝： | 144-PBGA（13x13） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2108BBG |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁當前第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁
IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Programming Information
148
March 5, 2009
March 2, 2005
E1 Transmit Backplane Frame Pulse Configuration (019H, 099H, 119H, 199H, 219H, 299H, 319H, 399H)
FPINV:
= 0: The positive pulse on the TSCFS pin is valid.
= 1: The negative pulse on the TSCFS pin is valid.
The FPINV of the eight framers should be the same value.
FPTYP:
= 0: Indicate that the signal on the TSCFS pin pulses during the first bit of each Basic Frame.
= 1: Indicate that the signal on the TSCFS pin asserts on the first bit of each Signaling Multi-Frame and asserts oppositely following the first bit of
each CRC Multi-Frame.
The FPTYP of the eight framers should be the same value.
E1 Transmit Backplane Parity Configuration and Status (01AH, 09AH, 11AH, 19AH, 21AH, 29AH, 31AH, 39AH)
TPTYP:
= 0: Even parity is employed in the first bit of TS0 of each Basic Frame input from the TSDn/MTSD pin, which means a logic one is expected in
the position when the number of ‘One’s in the previous Basic Frame is odd.
= 1: Odd parity is employed in the first bit of TS0 of each Basic Frame input from the TSDn/MTSD pin, which means a logic one is expected in the
position when the number of ‘One’s in the previous Basic Frame is even.
TPTYE:
This bit decides whether to generate an interrupt when a parity error is detected on the TSDn/MTSD pin.
= 0: No interrupt is generated when a parity error is detected on the TSDn/MTSD pin.
= 1: An interrupt on the INT pin is generated when a parity error is detected on the TSDn/MTSD pin.
TDI:
This bit indicates the parity error detected on the TSDn/MTSD pin.
= 0: No parity error is detected on the TSDn/MTSD pin.
= 1: A parity error is detected on the TSDn/MTSD pin.
This bit is cleared to ‘0’ when it is read.
PTY_EXTD:
= 0: The parity checking is calculated over the previous Basic frame, excluding the first bit of TS0 on the TSDn/MTSD pin.
= 1: The parity checking is calculated over the previous Basic frame, including the first bit of TS0 on the TSDn/MTSD pin.
Bit No.
7
6
5
4
3
2
1
0
Bit Name
Reserved
FPINV
Reserved
FPTYP
Reserved
Type
R/W
Default
00
Bit No.
7
6
5
4
3
2
1
0
Bit Name
TPTYP
TPTYE
TDI
Reserved
PTY_EXTD
Reserved
Type
R/W
R
R/W
Default
00
X
0
相關PDF資料 |
PDF描述 |
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