參數(shù)資料
型號: IDT723613L20PF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36
中文描述: 64 X 36 OTHER FIFO, 12 ns, PQFP120
封裝: TQFP-120
文件頁數(shù): 22/26頁
文件大小: 193K
代理商: IDT723613L20PF
22
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT723613 CMOS CLOCKED FIFO WITH
BUS-MATCHING AND BYTE SWAPPING 64 x 36
4661 drw14
CLKA
ENA
A0 - A35
MBA
CSA
W/
R
A
CLKB
MBF1
CSB
SIZ1, SIZ0
ENB
B0 - B35
W/
R
B
W1
t
ENS
t
ENH
t
DH
t
EN
t
ENH
W1 (Remains valid in Mail1 Register after read)
FIFO Output Register
t
ENS
t
ENH
t
ENS
t
ENH
t
ENS
t
ENH
t
DS
t
PMF
t
PMF
t
ENS
t
PMR
t
MDV
t
DIS
NOTE:
1. Port-B parity generation off (PGB = LOW).
Figure 14. Timing for Mail1 Register and
MBF1
Flag
NOTES:
1. t
SKEW2
is the mnimumtime between a rising CLKA edge and a rising CLKB edge for
AF
to transition HIGH in the next CLKA cycle. If the time between the rising CLKA edge
and rising CLKB edge is less than tSKEW2, then
AF
may transition HIGH one CLKB cycle later than shown.
2. FIFO write (
CSA
= L0W, W/
R
A = HIGH, MBA = LOW), FIFO read (
CSB
= LOW, W/
R
B = LOW, MBB = LOW).
3. Port-B size of long word is selected for FIFO read by SIZ1 = LOW, SIZ0 = LOW. If port B size is word or byte, t
SKEW2
is referenced fromthe last word or byte read of the
long word, respectively.
Figure 13. Timing for
AF
when the FIFO is Almost Full
AF
CLKA
ENA
CLKB
ENB
3145 drw13
1
2
t
ENS
t
ENH
t
ENS
t
ENH
[64-(X+1)] Long Words in FIFO
(64-X) Long Words in FIFO
t
SKEW2(1)
t
PAF
t
PAF
相關PDF資料
PDF描述
IDT723613L20PQF CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36
IDT723613 CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36
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IDT72361315PFI Single Low-Power Operational Amplifier 5-SOT-23 -40 to 85
IDT72361315PQF CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36
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