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參數(shù)資料
| 型號： | IDT70V7519S166BF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 3.3V 256K x 36 SYNCHRONOUS BANK-SWITCHABLE DUAL-PORT STATIC RAM WITH 3.3V OR 2.5V INTERFACE |
| 中文描述： | 256K X 36 DUAL-PORT SRAM, 12 ns, PBGA208 |
| 封裝： | FBGA-208 |
| 文件頁數(shù)： | 9/22頁 |
| 文件大?。?/td> | 490K |
| 代理商： | IDT70V7519S166BF |
6.42
IDT70V7519S
High-Speed 256K x 36 Synchronous Bank-Switchable Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
17
ADDRESS
An
CLK
DATAOUT
Qx - 1
(2)
Qx
Qn
Qn + 2
(2)
Qn + 3
ADS
CNTEN
tCYC2
tCH2
tCL2
5618 drw 16
tSA
tHA
tSAD tHAD
tCD2
tDC
READ
EXTERNAL
ADDRESS
READ WITH COUNTER
COUNTER
HOLD
tSAD tHAD
tSCN tHCN
READ
WITH
COUNTER
Qn + 1
Timing Waveform of Pipelined Read with Address Counter Advance(1)
NOTES:
1.
CE0, OE, BEn = VIL; CE1, R/W, and REPEAT = VIH.
2. If there is no address change via
ADS = VIL (loading a new address) or CNTEN = VIL (advancing the address), i.e. ADS = VIH and CNTEN = VIH, then
the data output remains constant for subsequent clocks.
Timing Waveform of Flow-Through Read with Address Counter Advance(1)
ADDRESS
An
CLK
DATAOUT
Qx
(2)
Qn
Qn + 1
Qn + 2
Qn + 3
(2)
Qn + 4
ADS
CNTEN
tCYC1
tCH1
tCL1
5618 drw 17
tSA
tHA
tSAD tHAD
READ
EXTERNAL
ADDRESS
READ WITH COUNTER
COUNTER
HOLD
tCD1
tDC
tSAD tHAD
tSCN tHCN
READ
WITH
COUNTER
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