參數(shù)資料
型號： ICSSSTUF32866EHLFT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 鎖存器
英文描述： SSTU SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA96
封裝： GREEN, MO-205CC, LFBGA-96
文件頁數(shù)： 10/27頁
文件大?。?/td> 310K
代理商： ICSSSTUF32866EHLFT
18
ICSSSTUF32866E
1038B—05/03/05
2. Device standard (cont'd)
2.7 Register timing (cont'd)
Figure 17 — Timing diagram for the second SSTU32866 (1:2 register-B configuration) device used in
pair; C0 = 1, C1 = 1; RST# switches from H to L
from high to low, all data and clock input signals must be held at valid logic levels (not floating) fo a
minimum time of tINACT max
CK
D1D14
RST#
DCS#
CSR#
CK#
Q1Q14
PAR_IN
PPO
(not used)
QERR#
tinact
tRPHL
RST# to Q
tRPHL
RST# to PPO
tRPLH
RST# to QERR#
H, L, or X
H or L
After
is switched
RST#
相關(guān)PDF資料
PDF描述
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ICSSSTVA16859CK SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, QCC56
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ICSSSTVA16859CKLF SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, QCC56
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