參數(shù)資料
型號(hào)： HW-V5-ML507-UNI-G-J
廠商： Xilinx Inc
文件頁數(shù)： 66/91頁
文件大?。?/td> 0K
描述： EVAL PLATFORM V5 FXT
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-5 FXT
類型： FPGA
適用于相關(guān)產(chǎn)品： ML507
所含物品： ML507 平臺(tái)，DVI 適配器，小型閃存卡和 SATA 轉(zhuǎn)接線
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
69
Virtex-5 Device Pin-to-Pin Input Parameter Guidelines
All devices are 100% functionally tested. The representative values for typical pin locations and normal clock loading are
listed in Table 91. Values are expressed in nanoseconds unless otherwise noted.
Table 91: Global Clock Setup and Hold Without DCM or PLL
Symbol
Description
Device
Speed Grade
Units
-3
-2
-1
Input Setup and Hold Time Relative to Global Clock Input Signal for LVCMOS25 Standard.(1)
TPSFD/ TPHFD
Full Delay (Legacy Delay or Default Delay)
Global Clock and IFF(2) without DCM or PLL
XC5VLX20T
N/A
1.63
–0.41
1.86
–0.41
ns
XC5VLX30
1.49
–0.35
1.60
–0.35
1.77
–0.35
ns
XC5VLX30T
1.49
–0.35
1.60
–0.35
1.76
–0.35
ns
XC5VLX50
1.48
–0.30
1.59
–0.30
1.76
–0.30
ns
XC5VLX50T
1.48
–0.30
1.59
–0.30
1.76
–0.30
ns
XC5VLX85
1.75
–0.49
1.89
–0.49
2.09
–0.49
ns
XC5VLX85T
1.75
–0.49
1.89
–0.49
2.09
–0.49
ns
XC5VLX110
1.74
–0.43
1.88
–0.43
2.09
–0.43
ns
XC5VLX110T
1.73
–0.43
1.88
–0.43
2.09
–0.43
ns
XC5VLX155
2.06
–0.50
2.36
–0.50
2.78
–0.49
ns
XC5VLX155T
2.06
–0.50
2.36
–0.50
2.78
–0.49
ns
XC5VLX220
N/A
2.57
–0.74
2.86
–0.74
ns
XC5VLX220T
N/A
2.57
–0.74
2.86
–0.74
ns
XC5VLX330
N/A
2.55
–0.56
2.85
–0.56
ns
XC5VLX330T
N/A
2.57
–0.56
2.86
–0.56
ns
XC5VSX35T
1.47
–0.16
1.59
–0.16
1.76
–0.16
ns
XC5VSX50T
1.62
–0.31
1.74
–0.31
1.93
–0.31
ns
XC5VSX95T
N/A
2.10
–0.44
2.32
–0.44
ns
XC5VSX240T
N/A
2.01
0.18
2.28
0.18
ns
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