參數(shù)資料
型號： EPM3128A
廠商： Altera Corporation
英文描述： Programmable Logic Device Family
中文描述： 可編程邏輯器件系列
文件頁數(shù)： 27/42頁
文件大?。?/td> 649K
代理商： EPM3128A
Altera Corporation
27
MAX 3000A Programmable Logic Device Family Data Sheet
Table 16. EPM3064A Internal Timing Parameters (Part 1 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
–4
–7
–10
Min
Max
Min
Max
Min
Max
t
IN
t
IO
Input pad and buffer delay
I/O input pad and buffer
delay
Shared expander delay
Parallel expander delay
Logic array delay
Logic control array delay
Internal output enable delay
Output buffer and pad
delay, slow slew rate = off
V
CCIO
= 3.3 V
Output buffer and pad
delay, slow slew rate = off
V
CCIO
= 2.5 V
Output buffer and pad
delay, slow slew rate = on
V
CCIO
= 2.5 V or 3.3 V
Output buffer enable delay,
slow slew rate = off
V
CCIO
= 3.3 V
Output buffer enable delay,
slow slew rate = off
V
CCIO
= 2.5 V
Output buffer enable delay,
slow slew rate = on
V
CCIO
= 2.5 V or 3.3 V
Output buffer disable delay
Register setup time
Register hold time
Register delay
Combinatorial delay
Array clock delay
Register enable time
Global control delay
Register preset time
Register clear time
0.6
0.6
1.1
1.1
1.4
1.4
ns
ns
t
SEXP
t
PEXP
t
LAD
t
LAC
t
IOE
t
OD1
1.8
0.4
1.5
0.6
0.0
0.8
3.0
0.7
2.5
1.0
0.0
1.3
3.9
0.9
3.2
1.2
0.0
1.8
ns
ns
ns
ns
ns
ns
C1 = 35 pF
t
OD2
C1 = 35 pF
1.3
1.8
2.3
ns
t
OD3
C1 = 35 pF
5.8
6.3
6.8
ns
t
ZX1
C1 = 35 pF
4.0
4.0
5.0
ns
t
ZX2
C1 = 35 pF
4.5
4.5
5.5
ns
t
ZX3
C1 = 35 pF
9.0
9.0
10.0
ns
t
XZ
t
SU
t
H
t
RD
t
COMB
t
IC
t
EN
t
GLOB
t
PRE
t
CLR
C1 = 5 pF
4.0
4.0
5.0
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1.3
0.6
2.0
1.0
2.9
1.3
0.7
0.6
1.2
0.6
1.0
1.3
1.3
1.2
0.9
1.9
1.0
1.5
2.1
2.1
1.6
1.3
2.5
1.2
2.2
2.9
2.9
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