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參數(shù)資料
| 型號： | EPM3128A |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可編程邏輯器件系列 |
| 文件頁數(shù)： | 15/42頁 |
| 文件大小： | 649K |
| 代理商： | EPM3128A |
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Altera Corporation
15
MAX 3000A Programmable Logic Device Family Data Sheet
Figure7
shows the timing information for the JTAG signals.
Figure 7. MAX 3000A JTAG Waveforms
Table7
shows the JTAG timing parameters and values for MAX 3000A
devices.
Table 7. JTAG Timing Parameters & Values for MAX 3000A Devices
Symbol
Parameter
Min
Max
Unit
t
JCP
t
JCH
t
JCL
t
JPSU
t
JPH
t
JPCO
t
JPZX
t
JPXZ
t
JSSU
t
JSH
t
JSCO
t
JSZX
t
JSXZ
TCK
clock period
100
ns
TCK
clock high time
50
ns
TCK
clock low time
50
ns
JTAG port setup time
20
ns
JTAG port hold time
45
ns
JTAG port clock to output
25
ns
JTAG port high impedance to valid output
25
ns
JTAG port valid output to high impedance
25
ns
Capture register setup time
20
ns
Capture register hold time
45
ns
Update register clock to output
25
ns
Update register high impedance to valid output
25
ns
Update register valid output to high impedance
25
ns
TDO
TCK
t
JPZX
t
JPCO
t
JPH
t
JPXZ
t
JCP
t
JPSU
t
JCL
t
JCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
t
JSSU
t
JSH
t
JSCO
t
JSXZ
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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