參數(shù)資料
型號： DSPB56721AG
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： SymphonyTM DSP56720 / DSP56721 Multi-Core Audio Processors
中文描述： SymphonyTM DSP56720 / DSP56721多核音頻處理器
文件頁數(shù)： 46/54頁
文件大?。?/td> 671K
代理商： DSPB56721AG
Symphony
TM
DSP56720 / DSP56721 Multi-Core Audio Processors, Rev.1
Freescale Semiconductor
46
Figure 39. EMC Signals (EMC PLL Bypassed; LRCC[CLKDIV] = 4)
Table 22. EMC Timing Parameters (EMC PLL Bypassed; LRCC[CLKDIV] = 8)
Parameter
Symbol
Min
Max
Unit
LCLK cycle time
T
clk
40
–
ns
Input setup to LCLK (except LGTA/LUPWAIT)
T
in_s
8
–
ns
Input hold from LCLK (except LGTA/LUPWAIT)
1
T
in_h
-1
–
ns
LGTA valid time
T
gta
42
–
ns
LUPWAIT valid time
T
upwait
42
–
ns
LALE negedge to LAD (address phase) invalid (address
latch hold time)
T
ale_h
5
–
ns
LALE valid time
T
ale
34
–
ns
Output setup from LCLK (except LAD[23:0] and LALE)
T
out_s
19
–
ns
Output hold from LCLK (except LAD[23:0] and LALE)
T
out_h
18
–
ns
T
in_s
T
in_h
LGTA
input
LA[2:0]/LBCTL/LCS[7:0]
LOE/LWE
LCKE/LSDA10/LSDDQM
LSDWE/LSDRAS/LSDCAS
LGPL[5:0]
Output Signals
LCLK
LAD[23:0] (data)
T
clk
LUPWAIT
input
T
gta
T
upwait
T
out_s
T
out_h
LALE
T
ad_s
T
ad_h
LAD[23:0]
T
ad_z
T
ale
T
ale_h
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