參數(shù)資料
型號(hào)： DSPB56364AF100
廠商： Freescale Semiconductor
文件頁數(shù)： 63/148頁
文件大?。?/td> 0K
描述： IC DSP 24BIT AUD 100MHZ 100-LQFP
標(biāo)準(zhǔn)包裝： 90
系列： DSP56K/Symphony
類型： 音頻處理器
接口： 主機(jī)接口，I²C，SAI，SPI
時(shí)鐘速率： 100MHz
非易失內(nèi)存： ROM（24 kB）
芯片上RAM： 11.25kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
External Clock Operation
DSP56364 Technical Data, Rev. 4.1
Freescale Semiconductor
3-5
3.7
External Clock Operation
The DSP56364 system clock is an externally supplied square wave voltage source connected to EXTAL
Figure 3-1 External Clock Timing
Internal clock low period
TL
With PLL disabled
—
ETC
—
With PLL enabled and MF
≤ 4
0.49
× ET
C ×
PDF
× DF/MF
—0.51
× ET
C ×
PDF
× DF/MF
With PLL enabled and MF > 4
0.47
× ET
C ×
PDF
× DF/MF
—0.53
× ET
C ×
PDF
× DF/MF
Internal clock cycle time with PLL enabled
TC
—ETC × PDF ×
DF/MF
—
Internal clock cycle time with PLL disabled
TC
—2
× ET
C
—
Instruction cycle time
ICYC
—TC
—
1 DF = Division Factor
Ef = External frequency
ETC = External clock cycle
MF = Multiplication Factor
PDF = Predivision Factor
TC = internal clock cycle
2 See the PLL and Clock Generation section in the DSP56300 Family Manual for a detailed discussion of the PLL.
Table 3-4 Internal Clocks (continued)
Characteristics
Symbol
Expression1, 2
Min
Typ
Max
EXTAL
VILC
VIHC
Midpoint
Note: The midpoint is 0.5 (VIHC + VILC).
ETH
ETL
ETC
3
4
2
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