參數(shù)資料
型號： DSP56303VF100R2
廠商： Freescale Semiconductor
文件頁數(shù)： 6/108頁
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描述： IC DSP 24BIT 100MHZ 196-BGA
標準包裝： 750
系列： DSP563xx
類型： 定點
接口： 主機接口，SSI，SCI
時鐘速率： 100MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 24kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 196-LBGA
供應(yīng)商設(shè)備封裝： 196-MAPBGA（15x15）
包裝： 帶卷 (TR)
DSP56303 Technical Data, Rev. 11
Freescale Semiconductor
A-13
;
EQUATES for Phase Locked Loop (PLL)
;
;------------------------------------------------------------------------
;
Register Addresses Of PLL
M_PCTL EQU $FFFFFD
; PLL Control Register
;
PLL Control Register
M_MF EQU $FFF
; Multiplication Factor Bits Mask (MF0-MF11)
M_DF EQU $7000
; Division Factor Bits Mask (DF0-DF2)
M_XTLR EQU 15
; XTAL Range select bit
M_XTLD EQU 16
; XTAL Disable Bit
M_PSTP EQU 17
; STOP Processing State Bit
M_PEN EQU 18
; PLL Enable Bit
M_PCOD EQU 19
; PLL Clock Output Disable Bit
M_PD EQU $F00000
; PreDivider Factor Bits Mask (PD0-PD3)
;------------------------------------------------------------------------
;
EQUATES for BIU
;
;------------------------------------------------------------------------
;
Register Addresses Of BIU
M_BCR EQU $FFFFFB
; Bus Control Register
M_DCR EQU $FFFFFA
; DRAM Control Register
M_AAR0 EQU $FFFFF9
; Address Attribute Register 0
M_AAR1 EQU $FFFFF8
; Address Attribute Register 1
M_AAR2 EQU $FFFFF7
; Address Attribute Register 2
M_AAR3 EQU $FFFFF6
; Address Attribute Register 3
M_IDR EQU
$FFFFF5
; ID Register
;
Bus Control Register
M_BA0W EQU $1F
; Area 0 Wait Control Mask (BA0W0-BA0W4)
M_BA1W EQU $3E0
; Area 1 Wait Control Mask (BA1W0-BA14)
M_BA2W EQU $1C00
; Area 2 Wait Control Mask (BA2W0-BA2W2)
M_BA3W EQU $E000
; Area 3 Wait Control Mask (BA3W0-BA3W3)
M_BDFW EQU $1F0000
; Default Area Wait Control Mask (BDFW0-BDFW4)
M_BBS EQU 21
; Bus State
M_BLH EQU 22
; Bus Lock Hold
M_BRH EQU 23
; Bus Request Hold
;
DRAM Control Register
M_BCW EQU $3
; In Page Wait States Bits Mask (BCW0-BCW1)
M_BRW EQU $C
; Out Of Page Wait States Bits Mask (BRW0-BRW1)
M_BPS EQU $300
; DRAM Page Size Bits Mask (BPS0-BPS1)
M_BPLE EQU 11
; Page Logic Enable
M_BME EQU 12
; Mastership Enable
M_BRE EQU 13
; Refresh Enable
M_BSTR EQU 14
; Software Triggered Refresh
M_BRF EQU $7F8000
; Refresh Rate Bits Mask (BRF0-BRF7)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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DSP56304GC66 制造商:未知廠家 制造商全稱:未知廠家 功能描述:24-Bit Digital Signal Processor
DSP56304GC80 制造商:未知廠家 制造商全稱:未知廠家 功能描述:24-Bit Digital Signal Processor
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