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參數(shù)資料
| 型號(hào)： | DS2196 |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 40/157頁 |
| 文件大小： | 734K |
| 代理商： | DS2196 |
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DS2196
40 of 157
CCR2A: COMMON CONTROL REGISTER 2 FRAMER A (Address = 38 Hex)
(MSB)
TFM
(LSB)
RFDL
TB8ZS
TSLC96
TZSE
RFM
RB8ZS
RSLC96
SYMBOL
POSITION
NAME AND DESCRIPTION
TFM
CCR2A.7
Transmit Frame Mode Select.
0 = D4 framing mode
1 = ESF framing mode
Transmit B8ZS Enable.
0 = B8ZS disabled
1 = B8ZS enabled
Transmit SLC–96 / Fs–Bit Insertion Enable.
Only set this
bit to a 1 in D4 framing applications. Must be set to 1 to source
the Fs pattern. See Section 18 for details.
0 = SLC–96/Fs–bit insertion disabled
1 = SLC–96/Fs–bit insertion enabled
Transmit FDL Zero Stuffer Enable.
Set this bit to 0 if using
the internal HDLC/BOC controller instead of the legacy support
for the FDL. See Section 18 for details.
0 = zero stuffer disabled
1 = zero stuffer enabled
Receive Frame Mode Select.
0 = D4 framing mode
1 = ESF framing mode
Receive B8ZS Enable.
0 = B8ZS disabled
1 = B8ZS enabled
Receive SLC–96 Enable.
Only set this bit to a 1 in D4/SLC–
96 framing applications. See Section 18 for details.
0 = SLC–96 disabled
1 = SLC–96 enabled
Receive FDL Zero Destuffer Enable.
Set this bit to 0 if using
the internal HDLC/BOC controller instead of the legacy support
for the FDL. See Section 18 for details.
0 = zero destuffer disabled
1 = zero destuffer enabled
TB8ZS
CCR2A.6
TSLC96
CCR2A.5
TZSE
CCR2A.4
RFM
CCR2A.3
RB8ZS
CCR2A.2
RSLC96
CCR2A.1
RFDL
CCR2A.0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS2196L | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| DS2196LN | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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