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參數(shù)資料
| 型號： | DK-DEV-4SGX230N |
| 廠商： | Altera |
| 文件頁數(shù)： | 55/82頁 |
| 文件大小： | 0K |
| 描述： | KIT DEVELOPMENT STRATIX IV |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 特色產(chǎn)品： | Stratix? IV GX FPGA Development Kit |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Stratix® IV GX |
| 類型： | FPGA |
| 適用于相關(guān)產(chǎn)品： | EP4SGX230K |
| 所含物品： | 開發(fā)板、通用電源、纜線和軟件 |
| 產(chǎn)品目錄頁面： | 607 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | EP4SGX230KF40C3N-ND - IC STRATIX IV FPGA 230K 1517FBGA EP4SGX230KF40C3-ND - IC STRATIX IV FPGA 230K 1517FBGA EP4SGX230HF35C3N-ND - IC STRATIX IV GX 230K 1152-FBGA EP4SGX230HF35C3-ND - IC STRATIX IV GX 230K 1152-FBGA EP4SGX230FF35C3NES-ND - IC STRATIX IV GX 230K 1152-FBGA EP4SGX230FF35C3ES-ND - IC STRATIX IV GX 230K 1152-FBGA EP4SGX230DF29C3NES-ND - IC STRATIX IV GX 230K 780-FBGA EP4SGX230DF29C3ES-ND - IC STRATIX IV GX 230K 780-FBGA |
| 其它名稱： | 544-2594 |
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Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–51
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
TriMatrix Memory Block Specifications
Table 1–36 lists the Stratix IV TriMatrix memory block specifications.
Table 1–36. TriMatrix Memory Block Performance Specifications for Stratix IV Devices (1) (Part 1 of 2)
Memory
Mode
Resources Used
Performance
ALUTs
TriMatrix
Memory
–1 Industrial
and –2 /–2×
Commercial/
Industrial
Speed Grade
–3
Commercial/
Industrial/
Military
Speed Grade
–4
Commercial/
Industrial
Speed Grade
–3
Industrial/
Military
Speed
Grade
–4
Industrial
Speed
Grade
Unit
MLAB
Single port
64×10
0
1
600
500
450
500
450
MHz
Simple dual-port
32×20
0
1
600
500
450
500
450
MHz
Simple dual-port
64×10
0
1
600
500
450
500
450
MHz
ROM 64×10
0
1
600
500
450
500
450
MHz
ROM 32×20
0
1
600
500
450
500
450
MHz
M9K
Block
Single-port
256×36
0
1
600
540
475
540
475
MHz
Simple dual-port
256×36
0
1
550
490
420
490
420
MHz
Simple dual-port
256×36, with the
read-during-write
option set to Old
Data
0
1
375
340
300
340
300
MHz
True dual port
512×18
0
1
490
430
370
430
370
MHz
True dual-port
512×18, with the
read-during-write
option set to Old
Data
0
1
375
335
290
335
290
MHz
ROM 1 Port
0
1
600
540
475
540
475
MHz
ROM 2 Port
0
1
600
540
475
540
475
MHz
Min Pulse Width
(clock high time)
—
750
800
850
800
850
ps
Min Pulse Width
(clock low time)
—
500
625
690
625
690
ps
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-JTL-EZ | CONVERTER MOD DC/DC 28V 25W |
| VE-JTJ-EZ | CONVERTER MOD DC/DC 36V 25W |
| AP432L-13 | IC VREF SHUNT PREC ADJ 8-SOP |
| VE-JTH-EZ | CONVERTER MOD DC/DC 52V 25W |
| RW2-4812S/H3/SMD | CONV DC/DC 2W 36-72VIN 12VOUT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| DK-DEV-5ASTD5N | 功能描述:KIT DEV ARRIA V FPGA 制造商:altera 系列:Arria V ST 零件狀態(tài):在售 類型:FPGA 配套使用產(chǎn)品/相關(guān)產(chǎn)品:Arria? V ST 內(nèi)容:板 標(biāo)準(zhǔn)包裝:1 |
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