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參數(shù)資料
| 型號： | CYV15G0402DXB |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | Quad HOTLink II SERDES(四HOTLink II并行轉(zhuǎn)換器) |
| 中文描述： | 二，四的HOTLink SERDES的（四的HOTLink二并行轉(zhuǎn)換器） |
| 文件頁數(shù)： | 24/29頁 |
| 文件大小： | 634K |
| 代理商： | CYV15G0402DXB |
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CYP15G0402DXB
CYV15G0402DXB
Document #: 38-02057 Rev. *G
Page 24 of 29
CYP(V)15G0402DXB HOTLink II Transmitter Switching Waveforms
Notes:
34. When REFCLK is configured for half-rate operation (TXRATE = HIGH) and data is captured using REFCLK instead of a TXCLKx clock (TXCKSEL = LOW), data
is captured using both the rising and falling edges of REFCLK.
35. The TXCLKO output is at twice the rate of REFCLK when TXRATE = HIGH and same rate as REFCLK when TXRATE = LOW. TXCLKO does not follow the
duty cycle of REFCLK.
36. The rising edge of TXCLKO output has no direct phase relationship to the REFCLK input.
TXCLKx
TXDx[9:0],
t
TXDH
t
TXDS
t
TXCLK
t
TXCLKH
t
TXCLKL
Transmit Interface
Write Timing
TXCKSEL
≠
LOW
TXOPx
REFCLK
Transmit Interface
Write Timing
TXCKSEL = LOW
TXRATE = LOW
t
REFCLK
t
REFH
t
REFL
t
TREFDS
t
TREFDH
TXDx[9:0],
TXOPx
t
TREFDH
Transmit Interface
Write Timing
TXCKSEL = LOW
TXRATE = HIGH
REFCLK
t
REFCLK
t
REFL
t
REFH
Note 34
TXDx[9:0],
TXOPx,
t
TREFDS
t
TREFDS
t
TREFDH
Note 34
TXCLKO
t
TXCLKO
Transmit Interface
TXCLKO Timing
TXCKSEL = LOW
TXRATE = HIGH
REFCLK
t
REFCLK
t
REFL
t
REFH
Note 35
Note 36
t
TXCLKOD+
t
TXCLKOD
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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| CYV15G0402DXB-BGI | 制造商:Cypress Semiconductor 功能描述: |
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| CYV15G0402DXB-BGXI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:Quad HOTLink II⑩ SERDES |
| CYV15G0403DXB | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:Independent Clock Quad HOTLink II⑩ Transceiver |
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