參數(shù)資料
型號： CY8C22213-24PVIT
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： 外設(shè)及接口
英文描述： PSoC Mixed Signal Array
中文描述： MULTIFUNCTION PERIPHERAL, PDSO20
封裝： 0.210 INCH, SSOP-20
文件頁數(shù)： 8/304頁
文件大?。?/td> 2956K
代理商： CY8C22213-24PVIT
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Contents
CY8C22xxx Preliminary Data Sheet
8
Document No. 38-12009 Rev. *D
December 22, 2003
17. Digital Blocks
.......................................................................................................189
17.1
Architectural Description....................................................................................................189
17.1.1
Input Multiplexers.........................................................................................189
17.1.2
Input Clock Resynchronization ....................................................................190
17.1.3
Output De-Multiplexers................................................................................191
17.1.4
Block Chaining Signals................................................................................191
17.1.5
Timer Function.............................................................................................192
17.1.6
Counter Function .........................................................................................192
17.1.7
Dead Band Function....................................................................................193
17.1.8
CRCPRS Function.......................................................................................194
17.1.9
SPI Protocol Function..................................................................................195
17.1.10
SPI Master Function ....................................................................................196
17.1.11
SPI Slave Function ......................................................................................196
17.1.12
Asynchronous Transmitter Function ............................................................197
17.1.13
Asynchronous Receiver Function................................................................197
17.2
Register Definitions............................................................................................................198
17.2.1
DxBxxDRx Registers ...................................................................................198
17.2.2
DxBxxCR0 Register.....................................................................................203
17.2.3
INT_MSK1 Register.....................................................................................203
17.2.4
DxBxxFN Registers......................................................................................203
17.2.5
DxBxxIN Registers.......................................................................................204
17.2.6
DxBxxOU Registers.....................................................................................204
17.3
Timing Diagrams................................................................................................................204
17.3.1
Timer Timing................................................................................................205
17.3.2
Counter Timing ............................................................................................206
17.3.3
Dead Band Timing .......................................................................................206
17.3.4
CRCPRS Timing..........................................................................................208
17.3.5
SPI Mode Timing .........................................................................................208
17.3.6
SPIM Timing ................................................................................................209
17.3.7
SPIS Timing.................................................................................................212
17.3.8
Transmitter Timing .......................................................................................215
17.3.9
Receiver Timing...........................................................................................216
SECTION E ANALOG SYSTEM
Top-Level Analog Architecture ......................................................................................................219
Analog Register Summary .............................................................................................................221
219
18. Analog Interface
...................................................................................................223
18.1
Architectural Description....................................................................................................223
18.1.1
Analog Data Bus Interface...........................................................................223
18.1.2
Analog Comparator Bus Interface................................................................223
18.1.3
Analog Column Clock Generation................................................................225
18.1.4
Decimator and Incremental ADC Interface..................................................226
18.1.5
Analog Modulator Interface (Mod Bits) ........................................................226
18.1.6
Analog Synchronization Interface (Stalling).................................................226
18.1.7
SAR Hardware Acceleration........................................................................226
18.2
Register Definitions............................................................................................................228
18.2.1
CMP_CR0 Register .....................................................................................228
18.2.2
CMP_CR1 Register .....................................................................................228
18.2.3
ASY_CR Register........................................................................................228
18.2.4
DEC_CR0 Register......................................................................................229
18.2.5
DEC_CR1 Register......................................................................................229
18.2.6
CLK_CR0 Register ......................................................................................230
相關(guān)PDF資料
PDF描述
CY8C22113 PSoC Mixed Signal Array
CY8C22113-24PI PSoC Mixed Signal Array
CY8C22113-24SI PSoC Mixed Signal Array
CY8C22213 PSoC Mixed Signal Array
CY8C22213-24LFI PSoC Mixed Signal Array
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參數(shù)描述
CY8C22213-24SI 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:PSOC® 3 CY8C38xx 核心處理器:8051 芯體尺寸:8-位 速度:67MHz 連通性:EBI/EMI，I²C，LIN，SPI，UART/USART 外圍設(shè)備:電容感應(yīng)，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):25 程序存儲器容量:64KB（64K x 8） 程序存儲器類型:閃存 EEPROM 大小:2K x 8 RAM 容量:8K x 8 電壓 - 電源 (Vcc/Vdd):1.71 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 2x20b，D/A 4x8b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-VFQFN 裸露焊盤 包裝:托盤
CY8C22213-24SIT 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤
CY8C22345 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:PSoC Programmable System-on-Chip
CY8C22345-12PVXE 功能描述:可編程片上系統(tǒng) - PSoC M8C 8bit Flash 16KB RoHS:否 制造商:Cypress Semiconductor 核心:8051 處理器系列:CY8C36 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:67 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:4 KB 片上 ADC:Yes 工作電源電壓:0.5 V to 5.5 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:QFN-68 安裝風(fēng)格:SMD/SMT
CY8C22345-12PVXET 功能描述:可編程片上系統(tǒng) - PSoC M8C 8bit Flash 16KB RoHS:否 制造商:Cypress Semiconductor 核心:8051 處理器系列:CY8C36 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:67 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:4 KB 片上 ADC:Yes 工作電源電壓:0.5 V to 5.5 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:QFN-68 安裝風(fēng)格:SMD/SMT
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