參數(shù)資料
型號(hào)： CY8C22213-24PVIT
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類(lèi)： 外設(shè)及接口
英文描述： PSoC Mixed Signal Array
中文描述： MULTIFUNCTION PERIPHERAL, PDSO20
封裝： 0.210 INCH, SSOP-20
文件頁(yè)數(shù)： 198/304頁(yè)
文件大小： 2956K
代理商： CY8C22213-24PVIT
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17. Digital Blocks
CY8C22xxx Preliminary Data Sheet
198
Document No. 38-12009 Rev. *D
December 22, 2003
17.2
Register Definitions
The Digital Block registers in this chapter are organized by
function, as presented in
Table 17-5
. To reference timing
diagrams associated with the digital block registers, see
“Timing Diagrams” on page 204
. For a complete list of the
Digital Block registers showing their addresses and bit
names, reference the
“Digital Register Summary” on
page 176
.
Data and Control Registers
17.2.1
DxBxxDRx Registers
The Data and Control registers presented in this section
encompass the DxBxxDR0, DxBxxDR1, and DxBxxDR2
registers. They are discussed according to which bank they
are located in and then detailed in tables by function type.
There are two banks of registers associated with the PSoC
device. Bank 0 encompasses the user registers for the
device and Bank 1 encompasses the configuration registers
for the device. Both are defined below. Reference the
“Bank
0 Registers” on page 86
and the
“Bank 1 Registers” on
page 145
for more information.
For additional information, reference the Register Details
chapter for the following registers:
DxBxxDR0 register on page 90
.
I
DxBxxDR1 register on page 91
.
I
DxBxxDR2 register on page 92
.
I
17.2.1.1
Timer Register Definitions
Table 17-5. Digital Block Register Definitions
DR0
DR1
DR2
CR0
Function
Down Counter
Down Counter
Down Counter
LFSR
Shifter
Shifter
Shifter
Shifter
Access
R*
R*
R*
R*
N/A
N/A
N/A
N/A
Function
Period
Period
Period
Polynomial
TX Buffer
TX Buffer
TX Buffer
N/A
Access
W
W
W
W
W
W
W
N/A
Function
Capture/Compare
Compare
N/A
Seed
RX Buffer
RX Buffer
N/A
RX Buffer
Access
RW
RW
N/A
RW
R
R
N/A
R
Function
Control
Control
Control
Control
Control/Status
Control/Status
Control/Status
Control/Status
Access
RW
RW
RW
RW
RW**
RW**
RW**
RW**
Timer
Counter
Dead Band
CRCPRS
SPIM
SPIS
TXUART
RXUART
LEGEND
* In Timer, Counter, Dead Band, and CRCPRS functions, a read of the DR0 register returns 00h and transfers DR0 to DR2.
** In the Communications functions, control bits are Read-Write access and status bits are Read-Only access.
Bank 0:
There are three 8-bit data registers and a 3-bit control register.
Table 17-6
explains the meaning of these registers in the context of timer opera-
tion.
Bank 1:
The mode bits in the Function register are block type specific. Other bit fields in this register, as well as the definitions of the Input and Output reg-
isters, are common to all functions and are described in the
“DxBxxIN Registers” on page 204
and the
“DxBxxOU Registers” on page 204
.
These mode bits are independent in the Timer block and control the Interrupt Type and the Compare Type. Timers have a special divide by one
mode, when the period of the DR0 register is set to 00h. In this configuration, the primary output Terminal Count (TC) is the inverted input clock.
The interrupt output is also the input clock inverted.
Table 17-6. Timer Data Register Descriptions
Name
Function
Count Value
Description
DR0
Not Directly Readable or Writeable.
During normal operation, DR0 stores the current count of a synchronous down counter.
When disabled, a write to the DR1 Period register is also simultaneously loaded into DR0 from the data bus.
When disabled, a read of DR0 returns 00h to the data bus and transfers the contents of DR0 to DR2. This transfer only
occurs in the addressed block.
When enabled, a read of DR0 returns 00h to the data bus and synchronously transfers the contents of DR0 to DR2. Oper-
ates simultaneously on the byte addressed and all higher bytes in a multi-block timer.
Note that when the hardware capture input is high, the read of DR0 (software capture) will be masked and will not occur. The
hardware capture input must be low for a software capture to occur.
相關(guān)PDF資料
PDF描述
CY8C22113 PSoC Mixed Signal Array
CY8C22113-24PI PSoC Mixed Signal Array
CY8C22113-24SI PSoC Mixed Signal Array
CY8C22213 PSoC Mixed Signal Array
CY8C22213-24LFI PSoC Mixed Signal Array
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
CY8C22213-24SI 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:PSOC® 3 CY8C38xx 核心處理器:8051 芯體尺寸:8-位 速度:67MHz 連通性:EBI/EMI，I²C，LIN，SPI，UART/USART 外圍設(shè)備:電容感應(yīng)，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):25 程序存儲(chǔ)器容量:64KB（64K x 8） 程序存儲(chǔ)器類(lèi)型:閃存 EEPROM 大小:2K x 8 RAM 容量:8K x 8 電壓 - 電源 (Vcc/Vdd):1.71 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 2x20b，D/A 4x8b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-VFQFN 裸露焊盤(pán) 包裝:托盤(pán)
CY8C22213-24SIT 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測(cè)/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲(chǔ)器容量:- 程序存儲(chǔ)器類(lèi)型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤(pán)
CY8C22345 制造商:CYPRESS 制造商全稱(chēng):Cypress Semiconductor 功能描述:PSoC Programmable System-on-Chip
CY8C22345-12PVXE 功能描述:可編程片上系統(tǒng) - PSoC M8C 8bit Flash 16KB RoHS:否 制造商:Cypress Semiconductor 核心:8051 處理器系列:CY8C36 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:67 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:4 KB 片上 ADC:Yes 工作電源電壓:0.5 V to 5.5 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:QFN-68 安裝風(fēng)格:SMD/SMT
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