參數(shù)資料
型號(hào)： CY8C21323
廠商： Cypress Semiconductor Corp.
英文描述： PSoC Mixed-Signal Array(PSoC混合信號(hào)陣列)
中文描述： PSoC混合信號(hào)陣列（的PSoC混合信號(hào)陣列）
文件頁(yè)數(shù)： 28/33頁(yè)
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代理商： CY8C21323
February 25, 2005
Document No. 38-12022 Rev. *G
28
CY8C21x23 Final Data Sheet
3. Electrical Specifications
Figure 3-6. Definition for Timing for Fast/Standard Mode on the I
2
C Bus
Table 3-26. 2.7V AC Characteristics of the I
2
C SDA and SCL Pins (Fast Mode not Supported)
Symbol
F
SCLI2C
T
HDSTAI2C
Description
Standard Mode
Min
Fast Mode
Min
Units
kHz
Notes
Max
Max
SCL Clock Frequency
0
100
–
–
Hold Time (repeated) START Condition. After this period,
the first clock pulse is generated.
LOW Period of the SCL Clock
4.0
–
–
–
μ
s
T
LOWI2C
T
HIGHI2C
T
SUSTAI2C
T
HDDATI2C
T
SUDATI2C
T
SUSTOI2C
T
BUFI2C
T
SPI2C
4.7
–
–
–
μ
s
μ
s
μ
s
μ
s
HIGH Period of the SCL Clock
4.0
–
–
–
Set-up Time for a Repeated START Condition
4.7
–
–
–
Data Hold Time
0
–
–
–
Data Set-up Time
250
–
–
–
ns
Set-up Time for STOP Condition
4.0
–
–
–
μ
s
μ
s
Bus Free Time Between a STOP and START Condition
4.7
–
–
–
Pulse Width of spikes are suppressed by the input filter.
–
–
–
–
ns
SDA
SCL
T
BUFI2C
T
SPI2C
T
HDSTAI2C
T
LOWI2C
T
SUDATI2C
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PDF描述
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