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參數(shù)資料
| 型號： | CY8C21323 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | PSoC Mixed-Signal Array(PSoC混合信號陣列) |
| 中文描述： | PSoC混合信號陣列（的PSoC混合信號陣列） |
| 文件頁數(shù)： | 10/33頁 |
| 文件大小： | 325K |
| 代理商： | CY8C21323 |
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February 25, 2005
Document No. 38-12022 Rev. *G
10
CY8C21x23 Final Data Sheet
1. Pin Information
1.1.4
24-Pin Part Pinout
Table 1-4. 24-Pin Part Pinout (MLF*)
Pin
No.
Type
Name
Description
CY8C21323 24-Pin PSoC Device
Digital
IO
Analog
I
1
2
P0[1]
SMP
Analog column mux input.
Switch Mode Pump (SMP) connection to
required external components.
Ground connection.
I2C Serial Clock (SCL).
I2C Serial Data (SDA).
Power
3
4
5
6
7
8
9
10
11
12
Power
Vss
P1[7]
P1[5]
P1[3]
P1[1]
NC
Vss
P1[0]
P1[2]
P1[4]
IO
IO
IO
IO
I2C Serial Clock (SCL), ISSP-SCLK.
No connection.
Ground connection.
I2C Serial Data (SDA), ISSP-SDATA.
Power
IO
IO
IO
Optional External Clock Input (EXT-
CLK).
13
14
IO
P1[6]
XRES
Input
Active high external reset with internal
pull down.
No connection.
Analog column mux input.
Analog column mux input.
Analog column mux input.
Analog column mux input.
15
16
17
18
19
NC
P0[0]
P0[2]
P0[4]
P0[6]
IO
IO
IO
IO
I
I
I
I
20
21
Power
Power
Vdd
Vss
Supply voltage.
Ground connection.
22
23
24
IO
IO
IO
I
I
I
P0[7]
P0[5]
P0[3]
Analog column mux input.
Analog column mux input.
Analog column mux input.
LEGEND
A = Analog, I = Input, and O = Output.
*
Note
The MLF package has a center pad that must be connected to the
same ground as the Vss pin.
MLF
(Top View)
A, I, P0[1]
SMP
Vss
I2C SCL, P1[7]
I2C SDA, P1[5]
P1[3]
1
2
3
4
5
6
18
17
16
15
14
13
P0[4], A, I
P0[2], A, I
P0[0], A, I
NC
XRES
P1[6]
2
2
2
2
2
1
P
P
P
V
V
P
7
8
9
1
1
1
I
N
V
I
P
E
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY8C21123 | PSoC Mixed-Signal Array(PSoC混合信號陣列) |
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| CY8C21534 | PSoC Mixed-Signal Array |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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