參數(shù)資料
型號： CS4265-DNZR
廠商： Cirrus Logic Inc
文件頁數(shù)： 32/46頁
文件大?。?/td> 0K
描述： IC CODEC 24BIT 104DB 32-QFN
標(biāo)準(zhǔn)包裝： 6,000
類型： 立體聲音頻
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 2
三角積分調(diào)變： 是
動(dòng)態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 104 / 104
電壓 - 電源，模擬： 3.13 V ~ 5.25 V
電壓 - 電源，數(shù)字： 3.13 V ~ 5.25 V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 32-QFN
供應(yīng)商設(shè)備封裝： 32-QFN 裸露焊盤（5x5）
包裝： 帶卷 (TR)
配用： 598-1001-ND - BOARD EVAL FOR CS4265 CODEC
38
DS657F3
CS4265
6.3.3
De-Emphasis Control (Bit 1)
Function:
The standard 50/15 s digital de-emphasis filter response, Figure 17, may be implemented for a sample
rate of 44.1 kHz when the DeEmph bit is configured as shownin Table 8. NOTE: De-emphasis is available
only in Single-Speed Mode.
6.4
ADC Control - Address 04h
6.4.1
Functional Mode (Bits 7:6)
Function:
Selects the required range of sample rates.
6.4.2
ADC Digital Interface Format (Bit 4)
Function:
The required relationship between LRCK, SCLK and SDOUT is defined by the ADC Digital Interface For-
mat bit. The options are detailed in Table 10 and may be seen in Figure 5 and Figure 6.
DeEmph
Description
0
Disabled (default)
1
44.1 kHz de-emphasis
Table 8. De-Emphasis Control
76
543
21
0
FM1
FM0
Reserved
ADC_DIF
Reserved
MuteADC
HPFFreeze
M/S
FM1
FM0
Mode
0
Single-Speed Mode: 4 to 50 kHz sample rates
0
1
Double-Speed Mode: 50 to 100 kHz sample rates
1
0
Quad-Speed Mode: 100 to 200 kHz sample rates
11
Reserved
Table 9. Functional Mode Selection
Gain
dB
-10dB
0dB
Frequency
T2 = 15 s
T1=50 s
F1
F2
3.183 kHz
10.61 kHz
Figure 17. De-Emphasis Curve
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