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參數(shù)資料
| 型號(hào)： | BX80532KC1900E |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 1900 MHz, MICROPROCESSOR |
| 文件頁數(shù)： | 65/132頁 |
| 文件大?。?/td> | 2316K |
| 代理商： | BX80532KC1900E |
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Electrical Specifications
2-24
Intel Xeon Processor MP with up to 2MB L3 Cache
Figure 7. Differential Clock Crosspoint Specification
Figure 8. System Bus Common Clock Valid Delay Timing Waveform
Crosspoint Specification
200
250
300
350
400
450
500
550
600
650
660 670 680 690 700 710 720 730 740 750 760 770 780 790 800 810 820 830 840 850
VHavg (V)
C
ros
s
ing
P
o
in
t(
V
)
250 + 0.5 (VHavg - 710)
550 + 0.5 (VHavg - 710)
550 mV
250 mV
Vhavg (mV)
C
ros
s
in
g
Po
int
(
m
V)
Crosspoint Specification
200
250
300
350
400
450
500
550
600
650
660 670 680 690 700 710 720 730 740 750 760 770 780 790 800 810 820 830 840 850
VHavg (V)
C
ros
s
ing
P
o
in
t(
V
)
250 + 0.5 (VHavg - 710)
550 + 0.5 (VHavg - 710)
550 mV
250 mV
Crosspoint Specification
200
250
300
350
400
450
500
550
600
650
660 670 680 690 700 710 720 730 740 750 760 770 780 790 800 810 820 830 840 850
VHavg (V)
C
ros
s
ing
P
o
in
t(
V
)
250 + 0.5 (VHavg - 710)
550 + 0.5 (VHavg - 710)
550 mV
250 mV
Vhavg (mV)
C
ros
s
in
g
Po
int
(
m
V)
BCLK0
BCLK1
Common Clock
Signal (@ driver)
Common Clock
Signal (@ receiver)
T0
T1
T2
T
Q
T
R
valid
T
P
T
P = T10: Common Clock Output Valid Delay
T
Q = T11: Common Clock Input Setup
T
R = T12: Common Clock Input Hold Time
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