參數(shù)資料
型號(hào)： AMD-8111
英文描述： AMD-8111? HyperTransport? I/O Hub Revision Guide
中文描述： AMD的8111？ HyperTransport的？ I / O集線器修訂指南
文件頁數(shù)： 217/378頁
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代理商： AMD-8111
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Chapter 4
Registers
217
24674
Rev. 3.00
April 2003
AMD-8111 HyperTransport I/O Hub Data Sheet
AMD Preliminary Information
CardBus Trap 1 and 2 I/O Address Register
DevB:3xB4
DevB:3xB4, DevB:3xB8, DevB:3xBC, and DevB:3xC0 combine to specify the address space for the
CARDBUS0 and CARDBUS1 trap events. These events can be used to generate SMIs or SCIs, load
the associated re-trigger timers (PM6C and PM70), or load the system inactivity timer. The
CARDBUS0 and CARDBUS1 trap events occur when the following is true:
CARDBUS0:
( (AD[15:0]
| ( (AD[31:10] | MASKPME1 == ADDRPME1 | MASKPME1) & (PCI MEM access) );
| MASKPIO1 == ADDRPIO1 | MASKPIO1) & (PCI IO access) )
CARDBUS1:
( (AD[15:0]
| ( (AD[31:10] | MASKPME2 == ADDRPME2 | MASKPME2) & (PCI MEM access) );
| MASKPIO2 == ADDRPIO2 | MASKPIO2) & (PCI IO access) )
Where AD is the address field of the host transaction. The mask bits for the I/O addresses cover
bits[7:0]. The mask bits for the memory addresses cover bits[17:10].
Default:
0000 0000h.
Attribute:
Read-write.
PCMCIA Trap 1 Memory Address Registers
DevB:3xB8
Default:
0000 0000h.
Attribute:
Read-write.
PCMCIA Trap 2 Memory Address Registers
DevB:3xBC
Default:
0000 0000h.
Attribute:
Read-write.
Bits
31:16
ADDRPIO2. I/O address for the CARDBUS1 trap event
.
15:0
ADDRPIO1. I/O address for the CARDBUS0 trap event
.
Description
Bits
31:10
ADDRPME1. Memory address for the CARDBUS0 trap event
. See DevB:3xB4 for details.
9:0
Reserved.
Description
Bits
31:10
ADDRPME2. Memory address for the CARDBUS1 trap event
. See DevB:3xB4 for details.
9:0
Reserved.
Description
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AMD-8111ACW 制造商:Advanced Micro Devices 功能描述:MPU 32-Bit CMOS 200MHz 3.3V 492-Pin BGA 制造商:Rochester Electronics LLC 功能描述:- Bulk
AMD-8131 制造商:未知廠家 制造商全稱:未知廠家 功能描述:AMD-8131 - AMD-8131 HyperTransport PCI-X Tunnel Data Sheet
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