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參數(shù)資料
| 型號： | ADV7180BSTZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 英文描述： | 10-Bit, 4 x Oversampling SDTV Video Decoder |
| 中文描述： | COLOR SIGNAL DECODER, PQFP64 |
| 封裝： | 10 X 10 MM, ROHS COMPLIANT, MS-026BCD, LQFP-64 |
| 文件頁數(shù)： | 98/112頁 |
| 文件大?。?/td> | 1320K |
| 代理商： | ADV7180BSTZ |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁當(dāng)前第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁
ADV7180
Table 104. Register Map Descriptions (Interrupt Operation)
Rev. A | Page 98 of 112
User Sub Map
Address Register
0x40
Bit
(Shading Indicates
Default State)
7 6 5 4 3 2 1 0
0 0
0 1
1 0
1 1
0 0
0 1
1 0
1 1
Comments
Open drain
Drive low when active
Drive high when active
Reserved
Manual interrupt mode disabled
Manual interrupt mode enabled
Not used
Reserved
Pseudo sync only
Color stripe only
Pseudo sync or color stripe
3 XTAL periods
15 XTAL periods
63 XTAL periods
Active until cleared
No change
SD input has caused the decoder to go
from an unlocked state to a locked state
No change
SD input has caused the decoder to go
from a locked state to an unlocked state
No Change
Denotes a change in the free-run status
No Change
Pseudo sync/color striping detected. See
Reg. 0x40 MV_INTRQ_SEL[1:0] for
selection
Do not clear
Clears SD_LOCK_Q bit
Do not clear
Clears SD_UNLOCK_Q bit
Not used
Not used
Not used
Do not clear
Clears SD_FR_CHNG_Q bit
Do not clear
Clears MV_PS_CS_Q bit
Not used
Masks SD_LOCK_Q bit
Unmasks SD_LOCK_Q bit
Masks SD_UNLOCK_Q bit
Unmasks SD_UNLOCK_Q bit
Not used
Not used
Not used
Masks SD_FR_CHNG_Q bit
Unmasks SD_FR_CHNG_Q bit
Masks MV_PS_CS_Q bit
Unmasks MV_PS_CS_Q bit
Not used
Bit Description
INTRQ_OP_SEL[1:0]. Interrupt drive
level select.
Notes
x
0
1
0 0
0 1
1 0
1 1
0
1
MPU_STIM_INTRQ. Manual interrupt
set mode.
Reserved
MV_INTRQ_SEL[1:0]. Macrovision
interrupt select.
Interrupt Configuration 1
INTRQ_DUR_SEL[1:0]. Interrupt
duration select.
SD_LOCK_Q.
0
1
SD_UNLOCK_Q.
Reserved.
Reserved.
Reserved.
SD_FR_CHNG_Q.
0
1
0
1
x
x
x
MV_PS_CS_Q.
0x42
Interrupt Status 1
(Read Only)
Reserved.
SD_LOCK_CLR.
x
x
x
0
1
0
1
0
1
0
0
0
0
1
0
1
These bits can be cleared
or masked in Registers
0x43 and 0x44,
respectively
SD_UNLOCK_CLR.
Reserved.
Reserved.
Reserved.
SD_FR_CHNG_CLR.
0
1
0
1
0
0
0
MV_PS_CS_CLR.
0x43
Interrupt Clear 1
(Write Only)
Reserved.
SD_LOCK_MSK.
0
1
SD_UNLOCK_MSK.
Reserved.
Reserved.
Reserved.
SD_FR_CHNG_MSK.
MV_PS_CS_MSK.
0x44
Interrupt Mask 1
(Read/Write)
Reserved.
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