tSL SCLOCK Low P" />
參數(shù)資料
型號(hào)： ADUC836BSZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 73/80頁(yè)
文件大?。?/td> 0K
描述： IC ADC DUAL 16BIT W/MCU 52-MQFP
產(chǎn)品培訓(xùn)模塊： Process Control
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC8xx
核心處理器： 8052
芯體尺寸： 8-位
速度： 12.58MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： POR，PSM，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 34
程序存儲(chǔ)器容量： 62KB（62K x 8）
程序存儲(chǔ)器類型： 閃存
EEPROM 大小： 4K x 8
RAM 容量： 2.25K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.25 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 7x16b; D/A 1x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 52-QFP
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 738 (CN2011-ZH PDF)
ADuC836
–74–
ADuC836
–75–
Parameter
Min
Typ
Max
Unit
SPI MASTER MODE TIMING (CPHA = 1)
tSL
SCLOCK Low Pulsewidth*
630
ns
tSH
SCLOCK High Pulsewidth*
630
ns
tDAV
Data Output Valid after SCLOCK Edge
50
ns
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
tDF
Data Output Fall Time
10
25
ns
tDR
Data Output Rise Time
10
25
ns
tSR
SCLOCK Rise Time
10
25
ns
tSF
SCLOCK Fall Time
10
25
ns
*Characterized under the following conditions:
Core clock divider bits CD2, CD1, and CD0 in PLLCON SFR set to 0, 1, and 1, respectively, i.e., core clock frequency = 1.57 MHz, and SPI bit rate selection bits
SPR1 and SPR0 in SPICON SFR are both set to 0.
SCLOCK
(CPOL = 0)
tDSU
SCLOCK
(CPOL = 1)
MOSI
MISO
MSB
LSB
LSB IN
BITS 6–1
tDHD
tDR
tDAV
tDF
tDOSU
tSH
tSL
tSR
tSF
MSB IN
Figure 75. SPI Master ModeTiming (CPHA = 1)
REV. A
相關(guān)PDF資料
PDF描述
ADUC841BSZ62-5 IC ADC/DAC 12BIT W/MCU 52-MQFP
VJ1825Y103JBGAT4X CAP CER 10000PF 1KV 5% X7R 1825
SCRU-01 CONN RCPT IP68 USB A PNL MNT
VJ1825Y153JBGAT4X CAP CER 0.015UF 1KV 5% X7R 1825
VJ1825Y223JBGAT4X CAP CER 0.022UF 1KV 5% X7R 1825
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參數(shù)描述
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ADUC841BCP62-5 制造商:Analog Devices 功能描述:MCU 8-Bit ADuC8xx 8052 CISC 62KB Flash 5V 56-Pin LFCSP EP
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