參數(shù)資料
型號： ADUC7128BSTZ126-RL
廠商： Analog Devices Inc
文件頁數(shù)： 46/92頁
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描述： IC DAS MCU ARM7 ADC/DDS 64-LQFP
產(chǎn)品培訓(xùn)模塊： ARM7 Applications & Tools
Intro to ARM7 Core & Microconverters
Process Control
Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 41.78MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： PLA，POR，PWM，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 28
程序存儲器容量： 126KB（63K x 16）
程序存儲器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x12b; D/A 1x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 64-LQFP
包裝： 標(biāo)準(zhǔn)包裝
配用： EVAL-ADUC7128QSPZ-ND - KIT DEV FOR ADUC7128
其它名稱： ADUC7128BSTZ126-RLDKR
ADuC7128/ADuC7129
Rev. 0 | Page 50 of 92
Table 58. Operating Modes
Mode
Core
Peripherals
PLL
XTAL/T2/T3
XIRQ
Start-Up/Power-On Time
Active
On
130 ms at CD = 0
Pause
On
24 ns at CD = 0; 3.06 μs at CD = 7
Nap
On
24 ns at CD = 0; 3.06 μs at CD = 7
Sleep
On
1.58 ms
Stop
On
1.7 ms
Table 59. Typical Current Consumption at 25°C
PC[2:0]
Mode
CD = 0
CD = 1
CD = 2
CD = 3
CD = 4
CD = 5
CD = 6
CD = 7
000
Active
33.1
21.2
13.8
10
8.1
7.2
6.7
6.45
001
Pause
22.7
13.3
8.5
6.1
4.9
4.3
4
3.85
010
Nap
3.8
011
Sleep
0.4
100
Stop
0.4
MMRs and Keys
To prevent accidental programming, a certain sequence must be
followed when writing in the PLLCON and POWCON registers
(see Table 60).
PLLKEYx Register
Name
Address
Default Value
Access
PLLKEY1
0xFFFF0410
0x0000
W
PLLKEY2
0xFFFF0418
0x0000
W
PLLCON Register
Name
Address
Default Value
Access
PLLCON
0xFFFF0414
0x21
R/W
POWKEYx Register
Name
Address
Default Value
Access
POWKEY1
0xFFFF0404
0x0000
W
POWKEY2
0xFFFF040C
0x0000
W
POWCON Register
Name
Address
Default Value
Access
POWCON
0xFFFF0408
0x0003
R/W
Table 60. PLLCON and POWCON Write Sequence
PLLCON
POWCON
PLLKEY1 = 0xAA
POWKEY1 = 0x01
PLLCON = 0x01
POWCON = user value
PLLKEY2 = 0x55
POWKEY2 = 0xF4
Table 61. PLLCON MMR Bit Designations
Bit
Value
Name
Description
7:6
Reserved.
5
OSEL
32 kHz PLL Input Selection.
Set by user to use the internal
32 kHz oscillator.
Set by default.
Cleared by user to use the
external 32 kHz crystal.
4:2
Reserved.
1:0
MDCLK
Clocking Modes.
00
Reserved.
01
PLL. Default configuration.
10
Reserved.
11
External clock on P0.7 pin.
Table 62. POWCON MMR Bit Designations
Bit
Value
Name
Description
7
Reserved.
6:4
PC
Operating Modes.
000
Active mode.
001
Pause mode.
010
Nap.
011
Sleep mode. IRQ0 to IRQ3 and Timer2
can wake up the
ADuC7128/ADuC7129.
100
Stop mode.
Others
Reserved.
3
RSVD
Reserved.
2:0
CD
CPU Clock Divider Bits.
000
41.779200 MHz.
001
20.889600 MHz.
010
10.444800 MHz.
011
5.222400 MHz.
100
2.611200 MHz.
101
1.305600 MHz.
110
654.800 kHz.
111
326.400 kHz.
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