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參數(shù)資料
| 型號： | ADSP-21362BBC-1AA |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | SHARC Processor |
| 中文描述： | 16-BIT, 55.55 MHz, OTHER DSP, PBGA136 |
| 封裝： | MO-205AE, BGA-136 |
| 文件頁數(shù)： | 29/52頁 |
| 文件大?。?/td> | 1320K |
| 代理商： | ADSP-21362BBC-1AA |
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ADSP-21362/ADSP-21363/ADSP-21364/ADSP-21365/ADSP-21366
Rev. A
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|
December 2006
Memory Write—Parallel Port
Use these specifications for asynchronous interfacing to memo-
ries (and memory-mapped peripherals) when the
ADSP-2136x is accessing external memory space.
Table 24. 8-Bit Memory Write Cycle
Parameter
Switching Characteristics
t
ALEW
t
ADAS
1
t
ALERW
t
RWALE
t
WRH
t
ADAH
1
t
WW
t
ADWL
t
ADWH
t
DWS
t
DWH
t
DAWH
D = (data cycle duration = the value set by the PPDUR Bits (5–1) in the PPCTL register)
×
t
PCLK
.
H = t
PCLK
(if a hold cycle is specified, else H = 0)
F = 7
×
t
PCLK
(if FLASH_MODE is set, else F = 0). If FLASH_MODE is set, D must be
≥
9
×
t
PCLK
.
t
PCLK
= (peripheral) clock period = 2
×
t
CCLK
Min
Max
Unit
ALE Pulse Width
AD15–0 Address Setup Before ALE Deasserted
ALE Deasserted to Write Asserted
Write Deasserted to ALE Asserted
Delay Between WR Rising Edge to Next WR Falling Edge
AD15–0 Address Hold After ALE Deasserted
WR Pulse Width
AD15–8 Address to WR Low
AD15–8 Address Hold After WR High
AD7–0 Data Setup Before WR High
AD7–0 Data Hold After WR High
AD15–8 Address to WR High
2 × t
PCLK
– 2.0
t
PCLK
– 2.8
2 × t
PCLK
– 3.8
H + 0.5
F + H + t
PCLK
– 2.3
t
PCLK
– 0.5
D – F – 2.0
t
PCLK
– 2.8
H
D – F + t
PCLK
– 4.0
H
D – F + t
PCLK
– 4.0
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1
On reset, ALE is an active high cycle. However, it can be configured by software to be active low.
Figure 20. Write Cycle for 8-Bit Memory Timing
AD15
-
8
VALID
ADDRESS
VALID ADDRESS
t
ADAS
AD7
-
0
ALE
RD
WR
t
ADAH
t
ADWH
t
ADWL
VALID DATA
t
DAWH
t
WRH
t
RWALE
VALID
ADDRESS
VALID DATA
t
ALEW
t
ALERW
t
WW
t
DWS
t
DWH
VALID ADDRESS
NOTE: MEMORY WRITES ALWAYS OCCUR IN GROUPS OF FOUR
BETWEEN ALE CYCLES. THIS FIGURE ONLY SHOWS TWO MEMORY
WRITES IN ORDER TO PROVIDE THE NECESSARY TIMING INFORMATION.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADSP-21362BBCZ-1AA | SHARC Processor |
| ADSP-21362KBC-1AA | SHARC Processor |
| ADSP-21362KBCZ-1AA | SHARC Processor |
| ADSP-21362WBBCZ-1A | SHARC Processor |
| ADSP-21363BBC-1AA | SHARC Processor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADSP-21362BBCZ-1AA | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 333 MHz Processor includes DTCP/SPDIF RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| ADSP-21362BSWZ-1AA | 功能描述:IC DSP 32BIT 333MHZ EPAD 144LQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內(nèi)核 接口:DSI，以太網(wǎng)，RS-232 時鐘速率:400MHz 非易失內(nèi)存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:431-FCPBGA（20x20） 包裝:托盤 |
| ADSP-21362KBC-1AA | 制造商:Analog Devices 功能描述:DSP Floating-Point 32-Bit/40-Bit 333MHz 333MIPS 136-Pin CSP-BGA |
| ADSP-21362KBCZ-1AA | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| ADSP-21362KSWZ-1AA | 制造商:Analog Devices 功能描述:IC SHARC DSP 333MHZ SMD LQFP144 |
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