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參數(shù)資料
| 型號： | ADSP-21160NKB-100 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 31/48頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 32BIT 400BGA |
| 產(chǎn)品培訓模塊： | SHARC Processor Overview |
| 標準包裝： | 1 |
| 系列： | SHARC® |
| 類型： | 浮點 |
| 接口： | 主機接口，連接端口，串行端口 |
| 時鐘速率： | 100MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 512kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.90V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設(shè)備封裝： | 400-PBGA（27x27） |
| 包裝： | 托盤 |
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–37–
REV. 0
ADSP-21160N
Table 26. Serial Ports—Internal Clock
Parameter
Min
Max
Unit
Switching Characteristics
tDFSI
TFS Delay After TCLK (Internally Generated TFS)
1
4.5
ns
tHOFSI
TFS Hold After TCLK (Internally Generated TFS)
–1.5
ns
tDDTI
Transmit Data Delay After TCLK
7.5
ns
tHDTI
Transmit Data Hold After TCLK
0ns
tSCLKIW
TCLK/RCLK Width
0.5tSCLK –1.5
0.5tSCLK+1.5
ns
1 Referenced to drive edge.
Table 27. Serial Ports—External Late Frame Sync
Parameter
Min
Max
Unit
Switching Characteristics
tDDTLFSE
Data Delay from Late External TFS or External RFS with
MCE = 1, MFD = 0
1
13
ns
tDDTENFS
Data Enable from Late FS or MCE = 1, MFD = 0
1.0
ns
1 MCE = 1, TFS enable and TFS valid follow tDDTLFSE and tDDTENFS.
Figure 24. Serial Ports—External Late Frame Sync
DRIVE
SAMPLE
DRIVE
TCLK
TFS
DT
DRIVE
SAMPLE
DRIVE
LATE EXTERNAL TFS
EXTERNAL RFS WITH MCE = 1, MFD = 0
1ST BIT
2ND BIT
DT
RCLK
RFS
1ST BIT
2ND BIT
tHOFSE/I
tSFSE/I
tDDTE/I
tDDTENFS
tDDTLFSE
tHDTE/I
tHOFSE/I
tSFSE/I
tDDTE/I
TDDTENFS
tDDTLFSE
tHDTE/I
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