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參數(shù)資料
| 型號： | ADSP-2104BPZ-80 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 27/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 產(chǎn)品變化通告： | Product Discontinuance 27/Oct/2011 |
| 標準包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 20MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 1.5kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
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ADSP-2104/ADSP-2109
REV. 0
–33–
TIMING PARAMETERS (ADSP-2104L/ADSP-2109L)
SERIAL PORTS
Frequency
13.824 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tSCK
SCLK Period
72.3
ns
tSCS
DR/TFS/RFS Setup before SCLK Low
8
ns
tSCH
DR/TFS/RFS Hold after SCLK Low
10
ns
tSCP
SCLKin Width
28
ns
Switching Characteristic:
tCC
CLKOUT High to SCLKout
18.1
33.1
0.25tCK
0.25tCK + 15
ns
tSCDE
SCLK High to DT Enable
0
ns
tSCDV
SCLK High to DT Valid
20
ns
tRH
TFS/RFSout Hold after SCLK High
0
ns
tRD
TFS/RFSout Delay from SCLK High
20
ns
tSCDH
DT Hold after SCLK High
0
ns
tTDE
TFS (alt) to DT Enable
0
ns
tTDV
TFS (alt) to DT Valid
18
ns
tSCDD
SCLK High to DT Disable
25
ns
tRDV
RFS (Multichannel, Frame Delay Zero)
20
ns
to DT Valid
CLKOUT
SCLK
TFS
RFS
DR
RFSIN
TFSIN
DT
( ALTERNATE
FRAME MODE )
tCC
tSCS
tSCH
tRD
tRH
RFSOUT
TFSOUT
tSCDV
tSCDE
tSCDH
tSCDD
tTDE
tTDV
( MULTICHANNEL MODE,
FRAME DELAY 0 {MFD = 0} )
tRDV
tSCK
tSCP
Figure 30. Serial Ports
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADSP-21060LCW-160 | IC DSP CONTROLLER 32BIT 240CQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ADSP-2104LKP-55 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Analog Devices 功能描述: |
| ADSP2105 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:(666.40 k) |
| ADSP-2105 | 制造商:AD 制造商全稱:Analog Devices 功能描述:ADSP-2100 Family DSP Microcomputers |
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