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參數(shù)資料
| 型號(hào)： | ADSP-2104BPZ-80 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 17/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 產(chǎn)品變化通告： | Product Discontinuance 27/Oct/2011 |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點(diǎn) |
| 接口： | 同步串行端口（SSP） |
| 時(shí)鐘速率： | 20MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 1.5kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
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ADSP-2104/ADSP-2109
–24–
REV. 0
20 MHz
Parameter
Min
Max
Unit
Timing Requirement:
tRDD
RD Low to Data Valid
12
ns
tAA
A0–A13, PMS, DMS, BMS to Data Valid
19.5
ns
tRDH
Data Hold from RD High
0
Switching Characteristic:
tRP
RD Pulse Width
17
ns
tCRD
CLKOUT High to RD Low
7.5
22.5
ns
tASR
A0–A13, PMS, DMS, BMS Setup before
2.5
ns
RD Low
tRDA
A0–A13, PMS, DMS, BMS Hold after RD
3.5
ns
Deasserted
tRWR
RD High to RD or WR Low
20
ns
Frequency Dependency
(CLKIN
≤ 20 MHz)
Parameter
Min
Max
Unit
Timing Requirement:
tRDD
RD Low to Data Valid
0.5tCK – 13 + w
ns
tAA
A0–A13, PMS, DMS, BMS to Data Valid
0.75tCK – 18 + w
ns
tRDH
Data Hold from RD High
0
Switching Characteristic:
tRP
RD Pulse Width
0.5tCK – 8 + w
ns
tCRD
CLKOUT High to RD Low
0.25tCK – 5
0.25tCK + 10
ns
tASR
A0–A13, PMS, DMS, BMS Setup before
RD Low
0.25tCK – 10
ns
tRDA
A0–A13, PMS, DMS, BMS Hold after RD
Deasserted
0.25tCK – 9
ns
tRWR
RD High to RD or WR Low
0.5tCK – 5
ns
NOTE
w = wait states
× t
CK.
TIMING PARAMETERS (ADSP-2104/ADSP-2109)
MEMORY READ
Figure 22. Memory Read
CLKOUT
A0 – A13
D
RD
WR
DMS, PMS
BMS
tRDH
tRWR
tRP
tASR
tCRD
tAA
tRDD
tRDA
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PDF描述 |
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