參數(shù)資料
型號： 82865GV
廠商： Intel Corp.
英文描述： Intel 865G/865GV Graphics and Memory Controller Hub
中文描述： 英特爾865G/865GV圖形和內(nèi)存控制器中樞
文件頁數(shù)： 54/249頁
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代理商： 82865GV
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Intel
82865G/82865GV GMCH Datasheet
55
Register Description
3.5
DRAM Controller/Host-Hub Interface Device
Registers (Device 0)
This section contains the DRAM Controller and Host-Hub Interface PCI configuration registers
listed in order of ascending offset address. The register address map is shown in
Table 6
.
Table 6. DRAM Controller/Host-Hub Interface Device Register
Address Map (Device 0) (Sheet 1 of 2)
Address
Offset
Register
Symbol
Register Name
Default Value
Access
00–01h
VID
Vendor Identification
8086h
RO
02–03h
DID
Device Identification
2570h
RO
04–05h
PCICMD
PCI Command
0006h
RO, R/W
06–07h
PCISTS
PCI Status
0090h
RO, R/WC
08h
RID
Revision Identification
See register
description
RO
09h
—
Intel Reserved
—
—
0Ah
SUBC
Sub-Class Code
00h
RO
0Bh
BCC
Base Class Code
06h
RO
0C
—
Intel Reserved
—
—
0Dh
MLT
Master Latency Timer
00h
RO
0Eh
HDR
Header Type
00h
RO
0Fh
—
Intel Reserved
—
—
10–13h
APBASE
Aperture Base Configuration
00000008h
RO, R/W
14–2Bh
—
Intel Reserved
—
—
2C–2Dh
SVID
Subsystem Vendor Identification
0000h
R/WO
2E–2Fh
SID
Subsystem Identification
0000h
R/WO
30–33h
—
Intel Reserved
—
—
34h
CAPPTR
Capabilities Pointer
E4h
RO
35–50h
—
Intel Reserved
—
RO
51h
AGPM
AGP Miscellaneous Configuration
00h
R/W
52h
GC
Graphics Control
0000_1000b
R/W
53h
CSABCONT
CSA Basic Control
00h
RO, R/W
54-5Fh
—
Intel Reserved
—
—
60h
FPLLCONT
FPLL Clock Control
00h
R/W, RO
61–89h
—
Intel Reserved
—
—
90h
PAM0
Programmable Attribute Map 0
00h
RO, R/W
91h
PAM1
Programmable Attribute Map 1
00h
RO, R/W
92h
PAM2
Programmable Attribute Map 2
00h
RO, R/W
93h
PAM3
Programmable Attribute Map 3
00h
RO, R/W
94h
PAM4
Programmable Attribute Map 4
00h
RO, R/W
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PDF描述
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