參數(shù)資料
型號(hào)： 82541ER
廠商： Intel Corp.
英文描述： 82541ER Gigabit Ethernet Controller
中文描述： 82541ER千兆位以太網(wǎng)控制器
文件頁(yè)數(shù)： 29/48頁(yè)
文件大小： 284K
代理商： 82541ER
82541ER Gigabit Ethernet Controller
Datasheet
23
Figure 2. AC Test Loads for General Output Pins
4.5
Timing Specifications
4.5.1
PCI Bus Interface
4.5.1.1
PCI Bus Interface Clock
Figure 3. PCI Clock Timing
CL
Table 18. PCI Bus Interface Clock Parameters
Symbol
Parameter
a
a. Rise and fall times are specified in terms of the edge rate measured in V/ns. This slew rate must be met across the
minimum peak-to-peak portion of the clock waveform as shown.
b. The minimum RST# slew rate applies only to the rising (de-assertion) edge of the reset signal and ensures that system
noise cannot render a monotonic signal to appear bouncing in the switching range.
PCI 66 MHz
PCI 33 MHz
Units
Min
Max
Min
Max
TCYC
CLK cycle time
15
30
30
ns
TH
CLK high time
6
11
ns
TL
CLK low time
6
11
ns
CLK slew rate
1.5
4
1
4
V/ns
RST# slew rate
b
50
50
mV/ns
0.6 Vcc
0.2 Vcc
Tl
0.5 Vcc
0.4 Vcc
0.3 Vcc
Tcyc
Th
(minimum)
3.3 V Clock
PCI Clock Timing.vsd
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PDF描述
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