參數(shù)資料
型號： 7630
英文描述： 7630 Group Datasheet Datasheet 840K/JAN.13.99
中文描述： 7630組數(shù)據(jù)表數(shù)據(jù)表840K/JAN.13.99
文件頁數(shù)： 46/49頁
文件大?。?/td> 840K
代理商： 7630
MITSUBISHI MICROCOMPUTERS
7630 Group
45
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
Table 11: Timing requirements
Symbol
Parameter
Limits
Unit
min.
typ.
max.
t
W
(RESET)
Reset input “L” pulse width
2
μ
s
t
C
(X
IN
)
External clock input cycle time
100
ns
t
WH
(X
IN
)
External clock input “H” pulse width
37
ns
t
WL
(X
IN
)
External clock input “L” pulse width
37
ns
t
C
(CNTR)
CNTR
0
, CNTR
1
input cycle time
(except bi-phase counter mode)
1600
ns
CNTR
0
input cycle time (bi-phase counter mode)
2000
ns
t
WH
(CNTR)
CNTR
0
, CNTR
1
input “H” pulse width
(except bi-phase counter mode)
800
ns
CNTR
0
input “H” pulse width (bi-phase counter mode)
1000
ns
t
WL
(CNTR)
CNTR
0
, CNTR
1
input “L” pulse width
(except bi-phase counter mode)
800
ns
CNTR
0
input “L” pulse width (bi-phase counter mode)
1000
ns
t
L
(CNTR
0
-TX
0
)
Lag of CNTR
0
and TX
0
input edges
(bi-phase counter mode)
500
ns
t
C
(TX
0
)
TX
0
input cycle time (bi-phase counter mode)
3200
ns
t
WH
(TX
0
)
TX
0
input “H” pulse width (bi-phase counter mode)
1600
ns
t
WL
(TX
0
)
TX
0
input “L” pulse width (bi-phase counter mode)
1600
ns
t
WH
(INT)
INT
0
, INT
1
input “H” pulse width
460
ns
t
WL
(INT)
INT
0
, INT
1
input “L” pulse width
460
ns
t
C
(S
CLK
)
Serial I/O clock input cycle time
8 · t
C
(X
IN
)
ns
t
WH
(S
CLK
)
Serial I/O clock input “H” pulse width
4 · t
C
(X
IN
)
ns
t
WL
(S
CLK
)
Serial I/O clock input “L” pulse width
4 · t
C
(X
IN
)
ns
t
SU
(S
IN
–S
CLK
)
Serial I/O input setup time
200
ns
t
H
(S
CLK
–S
IN
)
Serial I/O input hold time
150
ns
(V
CC
=4.0 to 5.5 V, V
SS
=AV
SS
=0 V, T
a
=–40 to 85
°
C unless otherwise noted)
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PDF描述
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