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參數(shù)資料
| 型號： | 73S1217F-68MR/F/PE |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 63/140頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SOC SMART CARD READER 68QFN |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | * |
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DS_1217F_002
73S1217F Data Sheet
Rev. 1.2
29
VDDFAULT
Analog functions
(VCO, PLL,
reference and bias
circuits, etc.)
USB Transceiver
(suspend mode)
32K OSC
ANALOG
COMPARE
High Speed OSC
MCLCKCtl - 32KEN
MISCtl1 - USBPEN
MISCtl1 - ANAPEN
MISCtl0 - PWRDN
VDDFCtl - VDDFEN
ACOMP - CMPEN
MCLCKCtl - HOSEN
Smart Card Power
SCVCCCtl - SCPRDN
+
USB
SUSPEND
These are the registers and
the names of the control bits.
These are the
block references.
PWRDN Signal
Note: the PWRDN Signal is not the direct version of the PWRDN Bit. There are delays from assertion of the
PWRDN bit to the assertion of the PWRDN Signal (32 MPU clocks) Refer to the Power Down sequence diagram.
PD_ANALOG
Flash Read Pulse
one-shot circuit
MISCtl1 - FRPEN
+
Figure 6: Power-Down Control
When the PWRDN bit is set, the clock subsystem will provide a delay of 32 MPUCLK cycles to allow the
program to set the STOP bit in the PCON register. This delay will enable the program to properly halt the
core before the analog circuits shut down (high speed oscillator, VCO/PLL, voltage reference and bias
circuitry, etc.). The PDMUX bit in SFR INT5Ctl should be set prior to setting the PWRDN bit in order to
configure the wake up interrupt logic. The power down mode is de-asserted by any of the interrupts
connected to external interrupts 0, 4 and 5 (external USR[0:7], smart card and Keypad). These interrupt
sources are OR’ed together and routed through delay logic into INT0 to provide this functionality. The
interrupt will turn on the power to all sections that were shut off and start the clock subsystem. After the
clock subsystem clocks start running, the MPUCLK begins to clock a 512 count delay counter. When the
counter times out, the interrupt will then be active on INT0 and the program can resume. Figure 7 shows
the detailed logic for waking up the 73S1217F from a power down state using these specific interrupt
sources. Figure 8 shows the timing associated with the power down mode.
相關(guān)PDF資料 |
PDF描述 |
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| 73S8010C-ILR/F | IC SMART CARD INTERFACE 28-SOIC |
| 73S8010R-ILR/F | IC SMART CARD INTERFACE 28-SOIC |
| 73S8014R-IL/F | IC SMART CARD 7816 EMV 20-SOIC |
| 73S8014RN-ILR/F | IC SMART CARD 7816 EMV 20-SOIC |
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參數(shù)描述 |
|---|---|
| 73S1217F-EB | 功能描述:開發(fā)板和工具包 - 8051 73S1217F Eval Brd (Usb Cable, Doc. Cd) RoHS:否 制造商:Silicon Labs 產(chǎn)品:Development Kits 工具用于評估:C8051F960, Si7005 核心: 接口類型:USB 工作電源電壓: |
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| 73S1217F-IMR/F | 制造商:TERIDIAN 制造商全稱:TERIDIAN 功能描述:Bus-Powered 80515 System-on-Chip with USB, ISO 7816 / EMV, PINpad and More |
| 73S13B | 制造商:QUARTZCOM 制造商全稱:QUARTZCOM the communications company 功能描述:-20 ~ +70 °C commercia l application -30 ~ +75 °C on request |
| 73S5040G01X0A | 制造商:NEX Computers 功能描述:INTEL 40GB SSD - Bulk |
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