參數(shù)資料
型號(hào)： 68HC05B
廠商： Motorola, Inc.
英文描述： High-density Complementary Metal Oxide Semiconductor (HCMOS) Microcomputer Unit
中文描述： 高密度互補(bǔ)金屬氧化物半導(dǎo)體（HCMOS）微機(jī)組
文件頁(yè)數(shù)： 34/298頁(yè)
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代理商： 68HC05B
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MOTOROLA
2-6
MC68HC05B6
Rev. 4
MODES OF OPERATION AND PIN DESCRIPTIONS
2
2.4
Low power modes
The STOP and WAIT instructions have different effects on the programmable timer, the serial
communications interface, the watchdog system, the EEPROM and the A/D converter. These
different effects are described in the following sections.
2.4.1
STOP
The STOP instruction places the MCU in its lowest power consumption mode. In STOP mode, the
internal oscillator is turned off, halting all internal processing including timer, serial
communications interface and the A/D converter (see flowchart in Figure 2-3). The only way for
the MCU to wake-up from the STOP mode is by receipt of an external interrupt or by the detection
of a reset (logic low on RESET pin or a power-on reset).
During STOP mode, the I-bit in the CCR is cleared to enable external interrupts (see
Section 10.1.5). The SM bit is cleared to allow nominal speed operation for the 4064 cycles count
while exiting STOP mode (see Section 2.4.3).
All other registers and memory remain unaltered and all input/output lines remain unchanged. This
continues until an external interrupt (IRQ) or reset is sensed, at which time the internal oscillator
is turned on. The external interrupt or reset causes the program counter to vector to the
corresponding locations ($1FFA, B and $1FFE, F respectively).
When leaving STOP mode, a t
PORL
internal cycles delay is provided to give the oscillator time to
stabilise before releasing CPU operation. This delay is selectable via a mask option to be either 16
or 4064 cycles. The CPU will resume operation by servicing the interrupt that wakes it up, or by
fetching the reset vector, if reset wakes it up.
Warning:
If t
PORL
is selected to be 16 cycles, it is recommended that an external clock signal is
used to avoid problems with oscillator stability while the device is in STOP mode.
Note:
The stacking corresponding to an eventual interrupt to go out of STOP mode will only
be executed when going out of STOP mode.
The following list summarizes the effect of STOP mode on the individual modules of the
MC68HC05B6.
–
–
–
–
–
–
–
The watchdog timer is reset; refer to Section 9.1.4.1
The EEPROM acts as read-only memory (ROM); refer to Section 3.6
All SCI activity stopped; refer to Section 6.13
The timer stops counting; refer to Section 5.6
The PLM outputs remain at current level; refer to Section 7.3
The A/D converter is disabled; refer to Section 8.3
The I-bit in the CCR is cleared
TPG
相關(guān)PDF資料
PDF描述
68HC05M68HC HCMOS Microcontroller Unit
68HC070KH12 8 BIT MICROCONTROLLER UNITS
68HC08KH12 8 BIT MICROCONTROLLER UNITS
68HC08M68HC HCMOS Microcontroller Unit
68HC11 Technical Data
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參數(shù)描述
68HC05B32B 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller
68HC05B32FN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller
68HC05B32FU 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller
68HC05BD2 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SPECIFICATION REV 2.0 (General Release)
68HC05BD7 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SPECIFICATION REV 2.0 (General Release)
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