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參數(shù)資料
| 型號： | 68HC05B |
| 廠商： | Motorola, Inc. |
| 英文描述： | High-density Complementary Metal Oxide Semiconductor (HCMOS) Microcomputer Unit |
| 中文描述： | 高密度互補(bǔ)金屬氧化物半導(dǎo)體（HCMOS）微機(jī)組 |
| 文件頁數(shù)： | 113/298頁 |
| 文件大?。?/td> | 4178K |
| 代理商： | 68HC05B |
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MC68HC05B6
Rev. 4
MOTOROLA
9-9
RESETS AND INTERRUPTS
9
9.2.3.2
Miscellaneous register
Note:
The bits shown shaded in the above representation are explained individually in the
relevant sections of this manual. The complete register plus an explanation of each bit
can be found in Section 3.8.
INTP, INTN — External interrupt sensitivity options
These two bits allow the user to select which edge the IRQ pin is sensitive to as shown in Table 9-3.
Both bits can be written to only while the I-bit is set, and are cleared by power-on or external reset.
Therefore the device is initialised with negative edge and low level sensitivity.
INTE — External interrupt enable
1 (set)
–
External interrupt function (IRQ) enabled.
0 (clear) –
External interrupt function (IRQ) disabled.
The INTE bit can be written to only while the I-bit is set, and is set by power-on or external reset,
thus enabling the external interrupt function.
Table 9-3 describes the various triggering options available for the IRQ pin, however it is important
to re-emphasize here that in order to avoid any conflict and spurious interrupt, it is only possible to
change the external interrupt options while the I-bit is set. Any attempt to change the external
interrupt option while the I-bit is clear will be unsuccessful. If an external interrupt is pending, it will
automatically be cleared when selecting a different interrupt option.
Note:
If the external interrupt function is disabled by the INTE bit and an external interrupt is
sensed by the edge detector circuitry, then the interrupt request is latched and the
interrupt stays pending until the INTE bit is set. The internal latch of the external
interrupt is cleared in the first part of the service routine (except for the low level
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Mscellaneous
$000C
POR
INTP
INTN
INTE
SFA
SFB
SM
WDOG 001 000
Table 9-3
IRQ sensitivity
INTP
0
0
1
1
INTN
0
1
0
1
IRQ sensitivity
Negative edge and low level sensitive
Negative edge only
Positive edge only
Positive and negative edge sensitive
TPG
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 68HC05M68HC | HCMOS Microcontroller Unit |
| 68HC070KH12 | 8 BIT MICROCONTROLLER UNITS |
| 68HC08KH12 | 8 BIT MICROCONTROLLER UNITS |
| 68HC08M68HC | HCMOS Microcontroller Unit |
| 68HC11 | Technical Data |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 68HC05B32B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| 68HC05B32FN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| 68HC05B32FU | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| 68HC05BD2 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SPECIFICATION REV 2.0 (General Release) |
| 68HC05BD7 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SPECIFICATION REV 2.0 (General Release) |
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